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參數(shù)資料
| 型號： | PSP271 |
| 英文描述： | 400V Single N-Channel Hi-Rel MOSFET in a TO-254AA package; A JANTXV2N7221 with Standard Packaging |
| 中文描述： | 模擬IC |
| 文件頁數(shù)： | 137/317頁 |
| 文件大?。?/td> | 3334K |
| 代理商： | PSP271 |
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PSB 2115
PSF 2115
Functional Description
Semiconductor Group
137
11.97
2.7.4.3
Function: MON-1 and MON-2 commands provide access to the IPAC internal S/Q
registers. MON1 controls the S
1
and Q channel, MON-2 controls the S
2
channel on the S-interface. In order to synchronize onto multiframing pulses
(TE, LT-T modes) and issue monitor-messages (LT-S mode) the MFD (Multi-
frame disable) bit in the configuration register must be set to ZERO.
MON-1 and MON-2 commands may be passed at any instant provided the S-
interface is activated. They are always one byte long.
MON-1, MON-2 Commands (S/Q Channel Access)
Direction S
→
IOM:
In the direction S-interface to IOM interface a 1 byte buffer is implemented.
Every time a S/Q message has been received on the S-interface which needs
to be forwarded to the IOM interface this message will be saved in a latch. This
latch allows retransmission of the old S/Q data on IOM in case the message
has not been read by the controller before a monitor timeout occurred.
While the latched data has not been read correctly from the monitor channel
the S/Q receiver will not reload the latch. Thus the IOM controller must read
out the S/Q messages from IOM once per 5 ms (multi-frame period). If this is
not guaranteed S/Q channel data may be lost.
Direction IOM
→
S:
No buffering is available in the direction IOM-interface to S-interface.
The IPAC will acknowledge a S/Q command correctly and transfer the
command into an internal S/Q transmit buffer if this command is received
during frame numbers 1-17. Once a command has been transferred into the
internal transmit register new S/Q commands received during frames 1-17 will
not be accepted by the IPAC (i.e. no acknowledgment issued with MR bit).
During frame numbers 18-20 however the monitor channel data is transferred
directly into the transmit register. During this period previously accepted S/Q
data could therefore be overwritten. To avoid this situation the controller must
be programmed to send no more than one S/Q command per multi-frame (5
ms).
Note that for both S
1
and S
2
channel a separate transmit register is reserved.
The above stated restriction thus applies only to S/Q commands referring to
the same channel.
Transmission of the stored data will commence with the new multi-frame.
Priority:
MON-1 commands have the highest priority, MON-2 command are treated
with second priority.
Modes:
Non-auto mode and transparent mode are available in all operational modes.
The SQM (SQ Mode) bit selects transparent mode (ONE) and non-auto mode
(ZERO).
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PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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| PS-P2G-6460P-H RPL | 制造商:Chenbro Micom Usa, Inc. 功能描述:VENDOR REPAIR/REPLACEMENT - Bulk |
| PS-P2G-6510PH | 制造商:Chenbro Micom Usa, Inc. 功能描述:510 WATT 2U PWS - Bulk |
| PS-P2G-6510P-H | 制造商:Chenbro Micom Usa, Inc. 功能描述:* ZIPPY, 510W EPS12V(24+8) PSU - Bulk |
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