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參數(shù)資料
| 型號： | PSD513B1-C-90UI |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Low Cost Field Programmable Microcontroller Peripherals |
| 中文描述： | 低成本現(xiàn)場可編程微控制器外圍設(shè)備 |
| 文件頁數(shù)： | 13/153頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | PSD513B1-C-90UI |
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Pin Name
Pin Function
Type
Function Descriptions
PE0
Port PE, pin 0
1. BHE
2. PSEN
3. WRH
4. UDS
5. SIZ0
6. PE0
7. PE0
8. PE0
Port PE, pin 1
1. ALE
2. PE1
3. PE1
4. PE1
Port PE, pin 2
1. Intr Out
2. PE2
3. PE2
4. PE2
Port PE, pin 3
1. Timer0-In
2. PE3
3. PE3
4. PE3
Port PE, pin 4
1. Timer1-In
2. PE4
3. PE4
4. PE4
5. TC0
Port PE, pin 5
1. Timer2-In
2. PE5
3. PE5
4. PE5
5. TC1
Port PE, pin 6
1. Timer3-In
2. PE6
3. PE6
4. PE6
5. TC2
Port PE, pin 7
1. APD CLK
2. PE7
3. PE7
4. PE7
5. TC3
VSTBY
I/O
Multiple functions
1. High byte enable, 16 bit data
2. Read program memory, 8031 signal
write high data byte
4. Upper Data Strobe
5. Byte enable, 68300 signal
6. I/O pin
7. ZPLD I/O pin
8. Latched Address Out – A0
Multiple functions
1. Address strobe
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A1
Multiple functions
1. Interrupt Controller Output
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A2
Multiple functions
1. Timer0 control input
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A3
Multiple functions
1. Timer1 control input
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A4
5. Timer0 Terminal Count
Multiple functions
1. Timer2 control input
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A5
5. Timer1 Terminal Count
Multiple functions
1. Timer3 control input
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A6
5. Timer2 Terminal Count
Multiple functions
1. Automatic Power Down Clock Input
2. I/O pin
3. ZPLD I/O pin
4. Latched Address Out – A7
5. Timer3 Terminal Count
SRAM power pin for standby
operation (battery backup)
Chip V
CC
power pin
Chip ground pin
PE1
I/O
PE2
I/O
PE3
I/O
PE4
I/O
PE5
I/O
PE6
I/O
PE7
I/O
VSTBY
I
V
CC
GND
V
CC
GND
I
I
PSD5XX Famly
10
Table 2.
PSD5XX Pin
Descriptions
(Cont.)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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