參數(shù)資料
型號(hào)： PSD4235G3-C-70B81
廠商： 意法半導(dǎo)體
英文描述： Flash In-System-Programmable Peripherals for 16-Bit MCUs
中文描述： Flash在系統(tǒng)可編程外設(shè)的16位微控制器
文件頁(yè)數(shù)： 81/89頁(yè)
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代理商： PSD4235G3-C-70B81
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PSD4235G2
Table 68. Port F Peripheral Data Mode Write Timing
Note: 1. RD has the same timing as DS, LDS, UDS, and PSEN (in 8031 combined mode).
2. WR has the same timing as the E, LDS, UDS, WRL, and WRH signals.
3. Any input used to select Port F Data Peripheral mode.
4. Data is already stable on Port F.
5. Data stable on ADIO pins to data on Port F.
Figure 47. Peripheral I/O Write Timing
Symbol
Parameter
Conditions
-70
-90
Unit
Min
Max
Min
Max
t
WLQV–PF
WR to Data Propagation Delay
(Note
2
)
25
35
ns
t
DVQV–PF
Data to Port F Data Propagation Delay
(Note
5
)
22
30
ns
t
WHQZ–PF
WR Invalid to Port F Tri-state
(Note
2
)
20
25
ns
tDVQV (PF)
tWLQV (PF)
tWHQZ (PF)
ADDRESS
DATA OUT
A/D BUS
WR
PORT F
DATA OUT
ALE/AS
AI05741
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PDF描述
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