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參數(shù)資料
| 型號： | PS21212 |
| 元件分類： | 運動控制電子 |
| 英文描述： | AC MOTOR CONTROLLER, 5 A, PDIP26 |
| 封裝： | HEAT SINK, POWER, DIP-26 |
| 文件頁數(shù)： | 8/8頁 |
| 文件大小： | 183K |
| 代理商： | PS21212 |
MITSUBISHI SEMICONDUCTOR <Dual-In-Line Package Intelligent Power Module>
PS21212
TRANSFER-MOLD TYPE
INSULATED TYPE
Aug. 1999
Fig. 8 TYPICAL DIP-IPM APPLICATION CIRCUIT EXAMPLE
Note 1 : To prevent the input signals oscillation, an RC coupling at each input is recommended, and the wiring of each input should be as short
as possible. (Less than 2cm)
2: By virtue of integrating an application specific type HVIC inside the module, direct coupling to CPU terminals without any opto-coupler
or transformer isolation is possible.
3: FO output is open collector type. This signal line should be pulled up to the positive side of the 5V power supply with approximately
5.1k
resistance.
4: FO output pulse width should be decided by connecting an external capacitor between CFO and VNC terminals (CFO). (Example : CFO
= 22 nF
→ tFO = 1.8 ms (typ.))
5: Each input signal line should be pulled up to the 5V power supply with approximately 4.7k
resistance (other RC coupling circuits at
each input may be needed depending on the PWM control scheme used and on the wiring impedances of the system’s printed circuit
board). Approximately a 0.22~2
F by-pass capacitor should be used across each power supply connection terminals.
6: To prevent errors of the protection function, the wiring of A, B, C should be as short as possible.
7: In the recommended protection circuit, please select the R1C5 time constant in the range 1.5~2
s.
8: Each capacitor should be put as nearby the pins of the DIP-IPM as possible.
9: To prevent surge destruction, the wiring between the smoothing capacitor and the P&N1 pins should be as short as possible. Approxi-
mately a 0.1~0.22
F snubber capacitor between the P&N1 pins is recommended.
HO
DIP-IPM
C1: Tight to lerance temp-compensated electrolytic type; C2,C3: 0.22~2
F R-category ceramic capacitor for noise filtering
(Note : The capacitance value depends on the PWM control used in the applied system)
C3
C2
C1
HO
IN
15V line
5V line
IN
COM
UOUT
VOUT
WOUT
VNO
CFO
GND
F
o
WN
VN
VCC
C
B
A
C4(CFO)
CFO
R1
C5
Shunt
Resistor
CIN
N1
N
W
V
U
P
VS
VB
VCC
Fo
WN
VN
UN
UN
WP
VP
UP
VNC
VN1
VPC
VP1
VWFS
VVFS
VUFS
VWFB
VVFB
VUFB
M
RSh
For detailed description of the boot-strap circuit
construction, please contact Mitsubishi Electric
C
P
U
N
I
T
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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