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參數(shù)資料
| 型號： | PPC440GP-3CC400E |
| 廠商： | APPLIEDMICRO INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Power PC 440GP Embedded Processor |
| 中文描述： | 32-BIT, 400 MHz, RISC PROCESSOR, CBGA552 |
| 封裝： | 25 X 25 MM, CERAMIC, BGA-552 |
| 文件頁數(shù)： | 69/83頁 |
| 文件大?。?/td> | 773K |
| 代理商： | PPC440GP-3CC400E |
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440GP – Power PC 440GP Embedded Processor
AMCC
69
Revision 1.07 – October 4, 2007
Data Sheet
I/O Specifications—400, 466, and 500MHz
Notes:
1. PerClk rising edge at package pin with a 10pF load trails the internal PLB clock by approximately 1.3ns.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup
Time
(T
IS
min)
Hold Time
(T
IH
min)
Valid Delay
(T
OV
max)
Hold Time
(T
OH
min)
I/O H
(minimum)
I/O L
(minimum)
External Slave Peripheral Interface
PerData00:31
3
1
9
0
15.3
10.2
PerClk
PerAddr00:31
3
1
7.6
0
15.3
10.2
PerClk
PerPar0:3
4
1
8.4
0
15.3
10.2
PerClk
PerWBE0:3
2.5
1
6.5
0
15.3
10.2
PerClk
PerCS0:7
na
na
6
0
15.3
10.2
PerClk
PerOE
na
na
6
0
15.3
10.2
PerClk
PerWE
na
na
7
0
15.3
10.2
PerBLast
2.5
1
5
na
15.3
10.2
PerClk
PerReady[RcvrInh]
5
1
na
na
na
na
PerClk
PerR/W
2.5
1
5.6
na
15.3
10.2
PerClk
DMAReq0:3
dc
dc
na
na
na
na
PerClk
DMAAck0:3
na
na
7
0
15.3
10.2
PerClk
EOT0:3/TC0:3
dc
dc
6.8
0
15.3
10.2
PerClk
External Master Peripheral Interface
PerClk
na
na
na
na
15.3
10.2
PLB Clk
1
ExtReset
na
na
6.2
0
15.3
10.2
PerClk
HoldReq
3.5
1
na
na
na
na
PerClk
HoldAck
na
na
6.4
0
15.3
10.2
PerClk
ExtReq
2.5
1
na
na
na
na
PerClk
ExtAck
na
na
6.2
0
15.3
10.2
PerClk
BusReq
na
na
6.2
0
15.3
10.2
PerClk
PerErr
4.5
1
na
na
15.3
10.2
PerClk
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