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參數(shù)資料
| 型號(hào)： | PMB2306 |
| 廠商： | SIEMENS AG |
| 英文描述： | PLL-Frequency Synthesizer PMB2306R/PMB2306T Version 2.2 |
| 中文描述： | 鎖相環(huán)頻率合成PMB2306R/PMB2306T版本2.2 |
| 文件頁數(shù)： | 12/35頁 |
| 文件大?。?/td> | 760K |
| 代理商： | PMB2306 |
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30%530%7
&LUFXLW'HVFULSWLRQ
Semiconductor Group
12
02.97
3URJUDPPLQJ7DEOHV
3URJUDPPLQJ7DEOHV
(cont’d)
*
** No ABL (Anti-Backlash-Pulse) gating performed. This means, that at the LD output the anti-backlash pulse
will appear. In the other cases the anti-backlash pulse will be surpressed at the LD output.
In general the shortest anti-backlash pulse gives the best system performance.
6WDWXV%LWV
0XOWLIXQFWLRQ2XWSXWV
0RGH
0RGH
0)2
0)2
5HPDUNV
0
0
I
RN
Φ
V
Φ
VN
Port 1
I
VN
Φ
RN
Φ
RN
,
REF
test mode
0
1
external charge pump mode 1
1
0
external charge pump mode 2
1
1
internal charge pump mode
6WDWXV%LWV
3'&XUUHQW0RGH
3'&XUUHQW
3'&XUUHQW
3'&XUUHQW
0
0
0
0.175
0
0
1
0.25
0
1
0
0.35
0
1
1
0.5
1
0
0
0.7
1
0
1
1
1
1
0
1.4
1
1
1
2
6WDWXV%LWV
$QWL%DFNODVK
3XOVH:LGWK
$QWL%DFNODVK
3XOVH:LGWK
W
Z
W\S
>QV@
$SSOLFDWLRQ
0
0
1.3*
9
DD
= 5 V
0
1
5
1
0
10
not recommended
1
1
13**
any application where
continuous lock detect required
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PMB2306R | PLL-Frequency Synthesizer PMB2306R/PMB2306T Version 2.2 |
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參數(shù)描述 |
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