參數(shù)資料
型號(hào)： PIC24FV32KA301-I/P
廠商： Microchip Technology
文件頁數(shù)： 127/352頁
文件大?。?/td> 0K
描述： MCU 32KB FLASH 2KB RAM 20-PDIP
標(biāo)準(zhǔn)包裝： 22
系列： PIC® XLP™ 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲(chǔ)器容量： 32KB（11K x 24）
程序存儲(chǔ)器類型： 閃存
EEPROM 大小： 512 x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
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PIC24FV32KA304 FAMILY
DS39995C-page 212
2011-2012 Microchip Technology Inc.
REGISTER 22-2:
AD1CON2: A/D CONTROL REGISTER 2
R/W-0
U-0
PVCFG1
PVCFG0
NVCFG0
OFFCAL
BUFREGEN
CSCNA
—
bit 15
bit 8
R/W-0
BUFS(1)
SMPI4
SMPI3
SMPI2
SMPI1
SMPI0
BUFM(1)
ALTS
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15-14
PVCFG<1:0>:
Converter Positive Voltage Reference Configuration bits
11
= 4 * Internal VBG(2)
10
= 2 * Internal VBG(3)
01
=External VREF+
00
=AVDD
bit 13
NVCFG0:
Converter Negative Voltage Reference Configuration bits
1
=External VREF-
0
=AVSS
bit 12
OFFCAL:
Offset Calibration Mode Select bit
1
= Inverting and non-inverting inputs of channel Sample-and-Hold are connected to AVSS
0
= Inverting and non-inverting inputs of channel Sample-and-Hold are connected to normal inputs
bit 11
BUFREGEN:
A/D Buffer Register Enable bit
1
= Conversion result is loaded into a buffer location determined by the converted channel
0
= A/D result buffer is treated as a FIFO
bit 10
CSCNA:
Scan Input Selections for CH0+ S/H Input for MUX A Setting bit
1
=Scans inputs
0
= Does not scan inputs
bit 9-8
Unimplemented:
Read as ‘0’
bit 7
BUFS:
Buffer Fill Status bit(1)
1
= A/D is filling the upper half of the buffer; user should access data in the lower half
0
= A/D is filling the lower half of the buffer; user should access data in the upper half
bit 6-2
SMPI<4:0>:
Interrupt Sample Rate Select bits
11111
= Interrupts at the completion of the conversion for each 32nd sample
11110
= Interrupts at the completion of the conversion for each 31st sample
00001
= Interrupts at the completion of the conversion for every other sample
00000
= Interrupts at the completion of the conversion for each sample
bit 1
BUFM:
Buffer Fill Mode Select bit(1)
1
= Starts filling the buffer at address, AD1BUF0 on the first interrupt, and AD1BUF(n/2) on the next
interrupt (Split Buffer mode)
0
= Starts filling the buffer at address, ADCBUF0, and each sequential address on successive
interrupts (FIFO mode)
Note 1:
This is only applicable when the buffer is used in FIFO mode (BUFREGEN = 0). In addition, BUFS is only
used when BUFM = 1.
2:
The voltage reference setting will not be within the specification with VDD below 4.5V.
3:
The voltage reference setting will not be within the specification with VDD below 2.3V.
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