參數(shù)資料
型號： PIC24FJ96GA010T-I/PT
廠商： Microchip Technology
文件頁數(shù)： 64/258頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 96KB 100TQFP
產(chǎn)品培訓(xùn)模塊： Graphics LCD System and PIC24 Interface
Asynchronous Stimulus
標準包裝： 1,200
系列： PIC® 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 16MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 84
程序存儲器容量： 96KB（32K x 24）
程序存儲器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TQFP
包裝： 帶卷 (TR)
配用： DM240011-ND - KIT STARTER MPLAB FOR PIC24F MCU
AC164333-ND - MODULE SKT FOR PM3 100QFP
DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2
MA160011-ND - DAUGHTER BOARD PICDEM LCD 16F91X
DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
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PIC24FJ128GA010 FAMILY
DS39747F-page 156
2005-2012 Microchip Technology Inc.
REGISTER 18-2:
PMMODE: PARALLEL PORT MODE REGISTER
R-0
R/W-0
BUSY
IRQM1
IRQM0
INCM1
INCM0
MODE16
MODE1
MODE0
bit 15
bit 8
R/W-0
WAITB1(1)
WAITB0(1)
WAITM3
WAITM2
WAITM1
WAITM0
WAITE1(1)
WAITE0(1)
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15
BUSY:
Busy bit (Master mode only)
1
= Port is busy (not useful when the processor stall is active)
0
= Port is not busy
bit 14-13
IRQM<1:0>:
Interrupt Request Mode bits
11
= Interrupt generated when Read Buffer 3 is read or Write Buffer 3 is written (Buffered PSP mode), or
on a read or write operation when PMA<1:0> = 11 (Addressable PSP mode only)
10
= No interrupt is generated, processor stall activated
01
= Interrupt is generated at the end of the read/write cycle
00
= No interrupt is generated
bit 12-11
INCM<1:0>:
Increment Mode bits
11
= PSP read and write buffers auto-increment (Legacy PSP mode only)
10
= Decrements ADDR<15,13:0> by 1 every read/write cycle
01
= Increments ADDR<15,13:0> by 1 every read/write cycle
00
= No increment or decrement of the address
bit 10
MODE16:
8/16-Bit Mode bit
1
= 16-bit mode: Data register is 16 bits, a read or write to the Data register invokes two 8-bit transfers
0
= 8-bit mode: Data register is 8 bits, a read or write to the Data register invokes one 8-bit transfer
bit 9-8
MODE<1:0>:
Parallel Port Mode Select bits
11
= Master mode 1 (PMCSx, PMRD/PMWR, PMENB, PMBE, PMA<x:0> and PMD<7:0>)
10
= Master mode 2 (PMCSx, PMRD, PMWR, PMBE, PMA<x:0> and PMD<7:0>)
01
= Enhanced PSP, control signals (PMRD, PMWR, PMCS, PMD<7:0> and PMA<1:0>)
00
= Legacy Parallel Slave Port, control signals (PMRD, PMWR, PMCS and PMD<7:0>)
bit 7-6
WAITB<1:0>:
Data Setup to Read/Write Wait State Configuration bits(1)
11
= Data Wait of 4 TCY; multiplexed address phase of 4 TCY
10
= Data Wait of 3 TCY; multiplexed address phase of 3 TCY
01
= Data Wait of 2 TCY; multiplexed address phase of 2 TCY
00
= Data Wait of 1 TCY; multiplexed address phase of 1 TCY
bit 5-2
WAITM<3:0>:
Read to Byte Enable Strobe Wait State Configuration bits
1111
= Wait of additional 15 TCY
...
0001
= Wait of additional 1 TCY
0000
= No additional Wait cycles (operation forced into one TCY)
bit 1-0
WAITE<1:0>:
Data Hold After Strobe Wait State Configuration bits(1)
11
= Wait of 4 TCY
10
= Wait of 3 TCY
01
= Wait of 2 TCY
00
= Wait of 1 TCY
Note 1:
WAITB and WAITE bits are ignored whenever WAITM<3:0> = 0000.
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