參數(shù)資料
型號： PIC24F16KL402-I/SO
廠商： Microchip Technology
文件頁數(shù)： 141/260頁
文件大?。?/td> 0K
描述： IC MCU 16BIT 16KB FLASH 28-SOIC
產品培訓模塊： Low Cost PIC24F KL Family Overview
特色產品： PIC24F "KL" Series MCUs
標準包裝： 27
系列： PIC® XLP™ 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 24
程序存儲器容量： 16KB（5.5K x 24）
程序存儲器類型： 閃存
EEPROM 大小： 512 x 8
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
數(shù)據轉換器： A/D 12x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
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CHAPTER 7 16-BIT TIMER/EVENT COUNTERS 0 AND 1
User’s Manual U15905EJ2V1UD
223
(2) Overflow
When the TMn register has counted the count clock from FFFFH to 0000H, the OVFn bit of the TMCn0 register
is set (1), and an overflow interrupt (INTOVFn) is generated at the same time (n = 0, 1). However, if the CCn0
register is set to compare mode (CMSn0 bit = 1) and to the value FFFFH when match clearing is enabled
(CCLRn bit = 1), then the TMn register is considered to be cleared and the OVFn bit is not set (1) when the
TMn register changes from FFFFH to 0000H. Also, the overflow interrupt (INTOVFn) is not generated .
When the TMn register is changed from FFFFH to 0000H because the TMCEn bit changes from 1 to 0, the
TMn register is considered to be cleared, but the OVFn bit is not set (1) and no INTOVFn interrupt is
generated.
Also, timer operation can be stopped after an overflow by setting the OSTn bit of the TMCn1 register to 1.
When the timer is stopped due to an overflow, the count operation is not restarted until the TMCEn bit of the
TMCn0 register is set (1).
Operation is not affected even if the TMCEn bit is set (1) during a count operation.
Remark
n = 0, 1
Figure 7-3. Operation After Overflow (When OSTn = 1)
Overflow
Count
start
Overflow
FFFFH
TMn
0
INTOVFn
OSTn
← 1
TMCEn
← 1
TMCEn
← 1
Remark
n = 0, 1
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PDF描述
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