參數(shù)資料
型號： PIC24EP64MC203-I/TL
廠商： Microchip Technology
文件頁數(shù)： 153/412頁
文件大小： 0K
描述： IC MCU 16BIT 64KB FLASH 36-VTLA
標準包裝： 73
系列： PIC® 24EP
核心處理器： PIC
芯體尺寸： 16-位
速度： 70 MIPs
連通性： I²C，IrDA，LIN，QEI，SPI，UART/USART
外圍設備： 欠壓檢測/復位，DMA，電機控制 PWM，POR，PWM，WDT
輸入/輸出數(shù)： 25
程序存儲器容量： 64KB（22K x 24）
程序存儲器類型： 閃存
RAM 容量： 4K x 16
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 8x10/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 36-VFTLA 裸露焊盤
包裝： 管件
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dsPIC33EPXXXGP50X, dsPIC33EPXXXMC20X/50X, AND PIC24EPXXXGP/MC20X
DS70657E-page 236
Preliminary
2011-2012 Microchip Technology Inc.
bit 7-6
DTC<1:0>: Dead-Time Control bits
11 = Dead-Time Compensation mode
10 = Dead-time function is disabled
01 = Negative dead time actively applied for Complementary Output mode
00 = Positive dead time actively applied for all output modes
bit 5
DTCP: Dead-Time Compensation Polarity bit(3)
When set to ‘1’:
If DTCMPx = 0, PWMLx is shortened and PWMHx is lengthened.
If DTCMPx = 1, PWMHx is shortened and PWMLx is lengthened.
When set to ‘0’:
If DTCMPx = 0, PWMHx is shortened and PWMLx is lengthened.
If DTCMPx = 1, PWMLx is shortened and PWMHx is lengthened.
bit 4
Unimplemented: Read as ‘0’
bit 3
MTBS: Master Time Base Select bit
1 = PWM generator uses the secondary master time base for synchronization and as the clock source
for the PWM generation logic (if secondary time base is available)
0 = PWM generator uses the primary master time base for synchronization and as the clock source
for the PWM generation logic
bit 2
CAM: Center-Aligned Mode Enable bit(2,4)
1 = Center-Aligned mode is enabled
0 = Edge-Aligned mode is enabled
bit 1
XPRES: External PWM Reset Control bit(5)
1 = Current-limit source resets the time base for this PWM generator if it is in Independent Time Base
mode
0 = External pins do not affect PWM time base
bit 0
IUE: Immediate Update Enable bit
1 = Updates to the active MDC/PDCx/DTx/ALTDTRx/PHASEx registers are immediate
0 = Updates to the active MDC/PDCx/DTx/ALTDTRx/PHASEx registers are synchronized to the
PWM time base
REGISTER 16-7:
PWMCONx: PWM CONTROL REGISTER (CONTINUED)
Note 1: Software must clear the interrupt status here and in the corresponding IFS bit in the interrupt controller.
2: These bits should not be changed after the PWM is enabled (PTEN = 1).
3: DTC<1:0> = 11 for DTCP to be effective; otherwise, DTCP is ignored.
4: The Independent Time Base (ITB = 1) mode must be enabled to use Center-Aligned mode. If ITB = 0, the
CAM bit is ignored.
5: To operate in External Period Reset mode, the ITB bit must be ‘1’ and the CLMOD bit in the FCLCONx
register must be ‘0’.
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