I2
參數(shù)資料
型號： PIC18LC801T-I/L
廠商： Microchip Technology
文件頁數(shù)： 128/319頁
文件大?。?/td> 0K
描述： IC MCU ROMLESS A/D PWM 84PLCC
標準包裝： 300
系列： PIC® 18C
核心處理器： PIC
芯體尺寸： 8-位
速度： 25MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 37
程序存儲器類型： ROMless
RAM 容量： 1.5K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 84-LCC（J 形引線）
包裝： 帶卷 (TR)
其它名稱： PIC18LC801TI/L
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PIC18F2585/2680/4585/4680
DS39625C-page 212
Preliminary
2007 Microchip Technology Inc.
17.4.6.1
I2C Master Mode Operation
The master device generates all of the serial clock
pulses and the Start and Stop conditions. A transfer is
ended with a Stop condition or with a Repeated Start
condition. Since the Repeated Start condition is also
the beginning of the next serial transfer, the I2C bus will
not be released.
In Master Transmitter mode, serial data is output
through SDA, while SCL outputs the serial clock. The
first byte transmitted contains the slave address of the
receiving device (7 bits) and the Read/Write (R/W) bit.
In this case, the R/W bit will be logic ‘0’. Serial data is
transmitted 8 bits at a time. After each byte is transmit-
ted, an Acknowledge bit is received. Start and Stop
conditions are output to indicate the beginning and the
end of a serial transfer.
In Master Receive mode, the first byte transmitted
contains the slave address of the transmitting device
(7 bits) and the R/W bit. In this case, the R/W bit will be
logic ‘1’ Thus, the first byte transmitted is a 7-bit slave
address followed by a ‘1’ to indicate the receive bit.
Serial data is received via SDA, while SCL outputs the
serial clock. Serial data is received 8 bits at a time. After
each byte is received, an Acknowledge bit is transmit-
ted. Start and Stop conditions indicate the beginning
and end of transmission.
The Baud Rate Generator used for the SPI mode
operation is used to set the SCL clock frequency for
either 100 kHz, 400 kHz or 1 MHz I2C operation. See
A typical transmit sequence would go as follows:
1.
The user generates a Start condition by setting
the Start Enable bit, SEN (SSPCON2<0>).
2.
SSPIF is set. The MSSP module will wait the
required start time before any other operation
takes place.
3.
The user loads the SSPBUF with the slave
address to transmit.
4.
Address is shifted out the SDA pin until all 8 bits
are transmitted.
5.
The MSSP Module shifts in the ACK bit from the
slave device and writes its value into the
SSPCON2 register (SSPCON2<6>).
6.
The MSSP module generates an interrupt at the
end of the ninth clock cycle by setting the SSPIF
bit.
7.
The user loads the SSPBUF with eight bits of
data.
8.
Data is shifted out the SDA pin until all 8 bits are
transmitted.
9.
The MSSP module shifts in the ACK bit from the
slave device and writes its value into the
SSPCON2 register (SSPCON2<6>).
10. The MSSP module generates an interrupt at the
end of the ninth clock cycle by setting the SSPIF
bit.
11. The user generates a Stop condition by setting
the Stop Enable bit, PEN (SSPCON2<2>).
12. Interrupt is generated once the Stop condition is
complete.
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PDF描述
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