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參數(shù)資料
| 型號(hào)： | PIC18F66J60 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet |
| 中文描述： | 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網(wǎng) |
| 文件頁(yè)數(shù)： | 206/474頁(yè) |
| 文件大?。?/td> | 3834K |
| 代理商： | PIC18F66J60 |
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PIC18F97J60 FAMILY
DS39762A-page 204
Advance Information
2006 Microchip Technology Inc.
TABLE 17-5:
REGISTERS ASSOCIATED WITH ECCP MODULES AND TIMER1 TO TIMER4
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values
on page
INTCON
GIE/GIEH PEIE/GIEL
TMR0IE
INT0IE
RBIE
TMR0IF
INT0IF
RBIF
59
RCON
PIR1
PIE1
IPR1
PIR2
PIE2
IPR2
PIR3
PIE3
IPR3
TRISB
TRISC
TRISD
(1)
TRISE
TRISG
TRISH
(2)
TMR1L
TMR1H
IPEN
PSPIF
PSPIE
PSPIP
OSCFIF
OSCFIE
OSCFIP
SSP2IF
SSP2IE
SSP2IP
TRISB7
TRISC7
TRISD7
TRISE7
TRISG7
(2)
TRISH7
Timer1 Register Low Byte
Timer1 Register High Byte
—
—
RI
TO
PD
POR
TMR2IF
TMR2IE
TMR2IP
TMR3IF
TMR3IE
TMR3IP
CCP4IF
CCP4IE
CCP4IP
TRISB1
TRISC1
TRISD1
TRISE1
TRISG1
(2)
TRISH1
BOR
TMR1IF
TMR1IE
TMR1IP
CCP2IF
CCP2IE
CCP2IP
CCP3IF
CCP3IE
CCP3IP
TRISB0
TRISC0
TRISD0
TRISE0
TRISG0
(2)
TRISH0
60
61
61
61
61
61
61
61
61
61
61
61
61
61
61
61
60
60
ADIF
ADIE
ADIP
CMIF
CMIE
CMIP
BCL2IF
BCL2IE
BCL2IP
TRISB6
TRISC6
TRISD6
TRISE6
TRISG6
(2)
TRISH6
RC1IF
RC1IE
RC1IP
ETHIF
ETHIE
ETHIP
RC2IF
RC2IE
RC2IP
TRISB5
TRISC5
TRISD5
TRISE5
TRISG5
(2)
TRISH5
TX1IF
TX1IE
TX1IP
r
r
r
TX2IF
TX2IE
TX2IP
TRISB4
TRISC4
TRISD4
TRISE4
TRISG4
TRISH4
SSP1IF
SSP1IE
SSP1IP
BCL1IF
BCL1IE
BCL1IP
TMR4IF
TMR4IE
TMR4IP
TRISB3
TRISC3
TRISD3
TRISE3
TRISG3
(2)
TRISH3
CCP1IF
CCP1IE
CCP1IP
—
—
—
CCP5IF
CCP5IE
CCP5IP
TRISB2
TRISC2
TRISD2
TRISE2
TRISG2
(2)
TRISH2
T1CON
TMR2
T2CON
PR2
TMR3L
TMR3H
RD16
Timer2 Register
—
Timer2 Period Register
Timer3 Register Low Byte
Timer3 Register High Byte
T1RUN
T1CKPS1
T1CKPS0 T1OSCEN
T1SYNC
TMR1CS
TMR1ON
60
60
60
60
60
60
T2OUTPS3 T2OUTPS2 T2OUTPS1 T2OUTPS0
TMR2ON
T2CKPS1
T2CKPS0
T3CON
TMR4
T4CON
PR4
CCPRxL
(3)
CCPRxH
(3)
CCPxCON
(3)
ECCPxAS
(3)
ECCPxDEL
(3)
Legend:
Note 1:
RD16
Timer4 Register
—
Timer4 Period Register
Capture/Compare/PWM Register x Low Byte
Capture/Compare/PWM Register x High Byte
PxM1
PxM0
ECCPxASE ECCPxAS2 ECCPxAS1 ECCPxAS0 PSSxAC1
PxRSEN
PxDC6
PxDC5
— = unimplemented, read as ‘
0
’, r = reserved. Shaded cells are not used during ECCP operation.
Applicable to 64-pin devices only.
Registers and/or specific bits are unimplemented on 64-pin devices.
Generic term for all of the identical registers of this name for all Enhanced CCP modules, where ‘x’ identifies the
individual module (ECCP1, ECCP2 or ECCP3). Bit assignments and Reset values for all registers of the same
generic name are identical.
T3CCP2
T3CKPS1
T3CKPS0
T3CCP1
T3SYNC
TMR3CS
TMR3ON
60
62
62
62
60
60
60
T4OUTPS3 T4OUTPS2 T4OUTPS1 T4OUTPS0
TMR4ON
T4CKPS1
T4CKPS0
DCxB1
DCxB0
CCPxM3
CCPxM2
PSSxAC0
PxDC2
CCPxM1
PSSxBD1
PxDC1
CCPxM0
PSSxBD0
PxDC0
60, 63
63
PxDC4
PxDC3
2:
3:
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