參數(shù)資料
型號(hào)： PIC18F46J50T-I/PT
廠商： Microchip Technology
文件頁數(shù)： 23/164頁
文件大小： 0K
描述： IC PIC MCU FLASH 64KB 44-TQFP
產(chǎn)品培訓(xùn)模塊： PIC18 J Series MCU Overview
PIC18F MPLAB® Starter Kit
標(biāo)準(zhǔn)包裝： 1,200
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 48MHz
連通性： I²C，SPI，UART/USART，USB
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT
輸入/輸出數(shù)： 34
程序存儲(chǔ)器容量： 64KB（32K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 3.8K x 8
電壓 - 電源 (Vcc/Vdd)： 2.15 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-TQFP
包裝： 帶卷 (TR)
配用： AC164330-ND - MODULE SKT FOR 44TQFP 18F45J10
2011 Microchip Technology Inc.
DS39931D-page 119
PIC18F46J50 FAMILY
REGISTER 9-3:
INTCON3: INTERRUPT CONTROL REGISTER 3 (ACCESS FF0h)
R/W-1
R/W-0
INT2IP
INT1IP
INT3IE
INT2IE
INT1IE
INT3IF
INT2IF
INT1IF
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
INT2IP:
INT2 External Interrupt Priority bit
1
=High priority
0
= Low priority
bit 6
INT1IP:
INT1 External Interrupt Priority bit
1
=High priority
0
= Low priority
bit 5
INT3IE:
INT3 External Interrupt Enable bit
1
= Enables the INT3 external interrupt
0
= Disables the INT3 external interrupt
bit 4
INT2IE:
INT2 External Interrupt Enable bit
1
= Enables the INT2 external interrupt
0
= Disables the INT2 external interrupt
bit 3
INT1IE:
INT1 External Interrupt Enable bit
1
= Enables the INT1 external interrupt
0
= Disables the INT1 external interrupt
bit 2
INT3IF:
INT3 External Interrupt Flag bit
1
= The INT3 external interrupt occurred (must be cleared in software)
0
= The INT3 external interrupt did not occur
bit 1
INT2IF:
INT2 External Interrupt Flag bit
1
= The INT2 external interrupt occurred (must be cleared in software)
0
= The INT2 external interrupt did not occur
bit 0
INT1IF:
INT1 External Interrupt Flag bit
1
= The INT1 external interrupt occurred (must be cleared in software)
0
= The INT1 external interrupt did not occur
Note:
Interrupt flag bits are set when an interrupt condition occurs, regardless of the state of its corresponding
enable bit or the Global Interrupt Enable bit. User software should ensure the appropriate interrupt flag bits
are clear prior to enabling an interrupt. This feature allows for software polling.
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PDF描述
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