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參數(shù)資料
| 型號： | PIC18F458ISPQTP |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | High Performance, 28/40-Pin Enhanced FLASH Microcontrollers with CAN |
| 中文描述： | 高性能，28/40-Pin增強型閃存微控制器和CAN |
| 文件頁數(shù)： | 29/384頁 |
| 文件大小： | 3119K |
| 代理商： | PIC18F458ISPQTP |
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2002 Microchip Technology Inc.
Preliminary
DS41159B-page 27
PIC18FXX8
3.7
Time-out Sequence
On power-up, the time-out sequence is as follows:
First, PWRT time-out is invoked after the POR time
delay has expired, then OST is activated. The total
time-out will vary based on oscillator configuration and
the status of the PWRT. For example, in RC mode with
the PWRT disabled, there will be no time-out at all.
Figure 3-3, Figure 3-4, Figure 3-5, Figure 3-6 and
Figure 3-7 depict time-out sequences on power-up.
Since the time-outs occur from the POR pulse, if MCLR
is kept low long enough, the time-outs will expire.
Bringing MCLR high will begin execution immediately
(Figure 3-5). This is useful for testing purposes or to
synchronize more than one PIC18FXX8 device
operating in parallel.
Table 3-2 shows the RESET conditions for some
Special Function Registers, while Table 3-3 shows the
RESET conditions for all registers.
TABLE 3-1:
TIME-OUT IN VARIOUS SITUATIONS
REGISTER 3-1:
RCON REGISTER BITS AND POSITIONS
TABLE 3-2:
STATUS BITS, THEIR SIGNIFICANCE AND THE INITIALIZATION CONDITION FOR
RCON REGISTER
Oscillator
Configuration
Power-up
(2)
Brown-out
(2)
Wake-up from
SLEEP or
Oscillator Switch
PWRTEN = 0
PWRTEN = 1
HS with PLL enabled
(1)
72 ms + 1024 T
OSC
+ 2 ms 1024 T
OSC
+ 2 ms 72 ms + 1024 T
OSC
+ 2 ms 1024 T
OSC
+ 2 ms
HS, XT, LP
72 ms + 1024 T
OSC
1024 T
OSC
EC
72 ms
External RC
72 ms
Note 1:
2 ms = Nominal time required for the 4X PLL to lock.
2:
72 ms is the nominal power-up timer delay.
72 ms + 1024 T
OSC
72 ms
72 ms
1024 T
OSC
—
—
—
—
R/W-0
IPEN
bit 7
U-0
—
U-0
—
R/W-1
RI
R/W-1
TO
R/W-1
PD
R/W-1
POR
R/W-1
BOR
bit 0
Condition
Program
Counter
RCON
Register
RI
TO
PD
POR
BOR
STKFUL
STKUNF
Power-on Reset
MCLR Reset during normal
operation
Software Reset during normal
operation
Stack Full Reset during normal
operation
Stack Underflow Reset during
normal operation
MCLR Reset during SLEEP
WDT Reset
WDT Wake-up
Brown-out Reset
Interrupt Wake-up from SLEEP
Legend:
u
= unchanged,
x
= unknown,
- = unimplemented bit, read as '0'
Note 1:
When the wake-up is due to an interrupt and the GIEH or GIEL bits are set, the PC is loaded with the
interrupt vector (
0x000008h
or
0x000018h
).
0000h
0--1 1100
1
1
1
0
0
u
u
0000h
0--u uuuu
u
u
u
u
u
u
u
0000h
0--0 uuuu
0
u
u
u
u
u
u
0000h
0--u uu11
u
u
u
1
1
u
1
0000h
0--u uu11
u
u
u
1
1
1
u
0000h
0--u 10uu
u
1
0
u
u
u
u
0000h
PC + 2
0--u 01uu
u--u 00uu
u
u
0
0
1
0
u
u
u
u
u
u
u
u
0000h
PC + 2
(1)
0--1 11u0
1
1
1
u
0
u
u
u--u 00uu
u
0
0
u
u
u
u
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PDF描述 |
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