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參數(shù)資料
| 型號： | PIC18F458IPQTP |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | High Performance, 28/40-Pin Enhanced FLASH Microcontrollers with CAN |
| 中文描述： | 高性能，28/40-Pin增強型閃存微控制器和CAN |
| 文件頁數(shù)： | 141/384頁 |
| 文件大?。?/td> | 3119K |
| 代理商： | PIC18F458IPQTP |
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2002 Microchip Technology Inc.
Preliminary
DS41159B-page 139
PIC18FXX8
16.5.8
SETUP FOR PWM OPERATION
The following steps should be taken when configuring
the ECCP1 module for PWM operation:
1.
Configure the PWM module:
a)
Disable the ECCP1/P1A, P1B, P1C and/or
P1D outputs by setting the respective TRISD
bits.
b)
Set the PWM period by loading the PR2
register.
c)
Set the PWM duty cycle by loading the
ECCPR1L register and ECCP1CON<5:4> bits.
d)
Configure the ECCP1 module for the desired
PWM operation, by loading the ECCP1CON
register with the appropriate value. With the
ECCP1M<3:0> bits, select the active high/low
levels for each PWM output. With the
EPWM1M<1:0> bits, select one of the
available Output modes.
e)
For Half-Bridge Output mode, set the dead-
band delay by loading the ECCP1DEL
register with the appropriate value.
2.
Configure and start TMR2:
a)
Clear the TMR2 interrupt flag bit by clearing
the TMR2IF bit in the PIR1 register.
b)
Set the TMR2 prescale value by loading the
T2CKPS bits (T2CON<1:0>).
c)
Enable Timer2 by setting the TMR2ON bit
(T2CON<2>) register.
Enable PWM outputs after a new cycle has
started:
a)
Wait until TMR2 overflows (TMR2IF bit
becomes a
’
1
’
). The new PWM cycle begins
here.
b)
Enable the ECCP1/P1A, P1B, P1C and/or
P1D pin outputs by clearing the respective
TRISD bits.
3.
TABLE 16-5:
REGISTERS ASSOCIATED WITH ENHANCED PWM AND TIMER2
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Value on
all other
RESETS
INTCON
GIE/GIEH
PEIE/GIEL
TMR0IE
INT0IE
RBIE
TMR0IF
INT0IF
RBIF
0000 000x 0000 000u
RCON
IPR2
PIR2
PIE2
TMR2
PR2
T2CON
TRISD
IPEN
—
—
—
—
—
—
—
—
RI
TO
PD
POR
TMR3IP
TMR3IF
TMR3IE
BOR
ECCP1IP
-0-0 1111 -1-1 1111
ECCP1IF
-0-0 0000 -0-0 0000
ECCP1IE
-0-0 0000 -0-0 0000
0--1 11qq 0--q qquu
CMIP
CMIF
CMIE
EEIP
EEIF
EEIE
BCLIP
BCLIF
BCLIE
LVDIP
LVDIF
LVDIE
Timer2 Module Register
Timer2 Module Period Register
—
TOUTPS3
PORTD Data Direction Register
0000 0000 0000 0000
1111 1111 1111 1111
TOUTPS2 TOUTPS1 TOUTPS0
TMR2ON T2CKPS1 T2CKPS0
-000 0000 -000 0000
1111 1111 1111 1111
ECCPR1H
ECCPR1L
ECCP1CON EPWM1M1 EPWM1M0
ECCPAS
ECCPASE
ECCP1DEL
EPDC7
Legend:
x
= unknown,
u
= unchanged,
-
= unimplemented, read as '0'. Shaded cells are not used by the ECCP module.
Enhanced Capture/Compare/PWM Register1 High Byte
Enhanced Capture/Compare/PWM Register1 Low Byte
EDC1B1
ECCPAS2
ECCPAS1 ECCPAS0
EPDC6
EPDC5
xxxx xxxx uuuu uuuu
xxxx xxxx uuuu uuuu
EDC1B0
ECCP1M3 ECCP1M2 ECCP1M1 ECCP1M0
0000 0000 0000 0000
PSSAC1
PSSAC0
PSSBD1
PSSBD0
0000 0000 0000 0000
EPDC3
EPDC2
EPDC1
EPDC4
EPDC0
0000 0000 uuuu uuuu
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