參數(shù)資料
型號： PIC18F4585-I
廠商： Microchip Technology Inc.
英文描述： Enhanced Flash Microcontrollers with ECAN? Technology, 10-Bit A/D and nanoWatt Technology
中文描述： 增強型閃存微控制器與ECAN？技術(shù)，10位A / D和納瓦技術(shù)
文件頁數(shù)： 337/484頁
文件大?。?/td> 3517K
代理商： PIC18F4585-I
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2004 Microchip Technology Inc.
Preliminary
DS39625B-page 335
PIC18F2585/2680/4585/4680
23.9.2
TIME QUANTA
As already mentioned, the Time Quanta is a fixed unit
derived from the oscillator period and baud rate
prescaler. Its relationship to T
BIT
and the Nominal Bit
Rate is shown in Example 23-6.
EXAMPLE 23-6:
CALCULATING T
Q
,
NOMINAL BIT RATE AND
NOMINAL BIT TIME
The frequencies of the oscillators in the different nodes
must be coordinated in order to provide a system wide
specified nominal bit time. This means that all oscilla-
tors must have a T
OSC
that is an integral divisor of T
Q
.
It should also be noted that although the number of T
Q
is programmable from 4 to 25, the usable minimum is
8 T
Q
.
There is no assurance that a bit time of less than
8 T
Q
in length will operate correctly.
23.9.3
SYNCHRONIZATION SEGMENT
This part of the bit time is used to synchronize the
various CAN nodes on the bus. The edge of the input
signal is expected to occur during the sync segment.
The duration is 1 T
Q
.
23.9.4
PROPAGATION SEGMENT
This part of the bit time is used to compensate for phys-
ical delay times within the network. These delay times
consist of the signal propagation time on the bus line
and the internal delay time of the nodes. The length of
the Propagation Segment can be programmed from
1 T
Q
to 8 T
Q
by setting the PRSEG2:PRSEG0 bits.
23.9.5
PHASE BUFFER SEGMENTS
The phase buffer segments are used to optimally
locate the sampling point of the received bit within the
nominal bit time. The sampling point occurs between
Phase Segment 1 and Phase Segment 2. These
segments can be lengthened or shortened by the
resynchronization process. The end of Phase Segment
1 determines the sampling point within a bit time.
Phase Segment 1 is programmable from 1 T
Q
to 8 T
Q
in duration. Phase Segment 2 provides delay before
the next transmitted data transition and is also
programmable from 1 T
Q
to 8 T
Q
in duration. However,
due to IPT requirements, the actual minimum length of
Phase Segment 2 is 2 T
Q
, or it may be defined to be
equal to the greater of Phase Segment 1 or the
Information Processing Time (IPT). The sampling point
should be as late as possible or approximately 80% of
the bit time.
23.9.6
The sample point is the point of time at which the bus
level is read and the value of the received bit is
determined. The sampling point occurs at the end of
Phase Segment 1. If the bit timing is slow and contains
many T
Q
, it is possible to specify multiple sampling of
the bus line at the sample point. The value of the
received bit is determined to be the value of the major-
ity decision of three values. The three samples are
taken at the sample point and twice before, with a time
of T
Q
/2 between each sample.
SAMPLE POINT
23.9.7
The Information Processing Time (IPT) is the time
segment starting at the sample point that is reserved
for calculation of the subsequent bit level. The CAN
specification defines this time to be less than or equal
to 2 T
Q
. The PIC18F2585/2680/4585/4680 devices
define this time to be 2 T
Q
. Thus, Phase Segment 2
must be at least 2 T
Q
long.
INFORMATION PROCESSING TIME
T
Q
(
μ
s) = (2 * (BRP + 1))/F
OSC
(MHz)
T
BIT
(
μ
s) = T
Q
(
μ
s) * number of T
Q
per bit interval
Nominal Bit Rate (bits/s) = 1/T
BIT
This frequency (F
OSC
) refers to the effective
frequency used. If, for example, a 10 MHz external
signal is used along with a PLL, then the effective
frequency will be 4 x 10 MHz which equals 40 MHz.
CASE 1:
For F
OSC
= 16 MHz, BRP<5:0> = 00h and
Nominal Bit Time = 8 T
Q
:
T
Q
= (2 * 1)/16 = 0.125
μ
s (125 ns)
T
BIT
= 8 * 0.125 = 1
μ
s (10
-6
s)
Nominal Bit Rate = 1/10
-6
= 10
6
bits/s (1 Mb/s)
CASE 2:
For F
OSC
= 20 MHz, BRP<5:0> = 01h and
Nominal Bit Time = 8 T
Q
:
T
Q
= (2 * 2)/20 = 0.2
μ
s (200 ns)
T
BIT
= 8 * 0.2 = 1.6
μ
s (1.6 * 10
-6
s)
Nominal Bit Rate = 1/1.6 * 10
-6
s =
625,000 bits/s
(625 Kb/s)
CASE 3:
For F
OSC
= 25 MHz, BRP<5:0> = 3Fh and
Nominal Bit Time = 25 T
Q
:
T
Q
= (2 * 64)/25 = 5.12
μ
s
T
BIT
= 25 * 5.12 = 128
μ
s (1.28 * 10
-4
s)
Nominal Bit Rate = 1/1.28 * 10
-4
=
7813 bits/s
(7.8 Kb/s)
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PDF描述
PIC18F4585-P Enhanced Flash Microcontrollers with ECAN? Technology, 10-Bit A/D and nanoWatt Technology
PIC18F458ELQTP High Performance, 28/40-Pin Enhanced FLASH Microcontrollers with CAN
PIC18F458ELSQTP High Performance, 28/40-Pin Enhanced FLASH Microcontrollers with CAN
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參數(shù)描述
PIC18F4585-I/ML 功能描述:8位微控制器 -MCU 48KB 3328 RAM w/ECAN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F4585-I/P 功能描述:8位微控制器 -MCU 48KB 3328 RAM w/ECAN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F4585-I/P 制造商:Microchip Technology Inc 功能描述:8-Bit Microcontroller IC
PIC18F4585-I/PT 功能描述:8位微控制器 -MCU 48KB 3328 RAM w/ECAN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F4585T-I/ML 功能描述:8位微控制器 -MCU 48KB 3328 RAM w/ECAN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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