參數(shù)資料
型號(hào)： PIC18F25J10-I/SS
廠商： Microchip Technology
文件頁數(shù)： 25/80頁
文件大小： 0K
描述： IC PIC MCU FLASH 16KX16 28SSOP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
PIC18 J Series MCU Overview
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 47
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 21
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SSOP（0.209"，5.30mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 643 (CN2011-ZH PDF)
配用： AC162074-ND - HEADER INTRFC MPLAB ICD2 44TQFP
MA180011-ND - MODULE PLUG-IN 18F25J10 28SOIC
AC162067-ND - HEADER INTRFC MPLAB ICD2 40/28P
AC164331-ND - MODULE SKT FOR 28SSOP 18F45J10
PIC16F8X
1998 Microchip Technology Inc.
DS30430C-page 31
6.3.1
SWITCHING PRESCALER ASSIGNMENT
The prescaler assignment is fully under software
control (i.e., it can be changed “on the fly” during
program execution).
EXAMPLE 6-1:
CHANGING PRESCALER
(TIMER0
→WDT)
BCF
STATUS, RP0
;Bank 0
CLRF
TMR0
;Clear TMR0
; and Prescaler
BSF
STATUS, RP0
;Bank 1
CLRWDT
;Clears WDT
MOVLW
b’xxxx1xxx’
;Select new
MOVWF
OPTION_REG
; prescale value
BCF
STATUS, RP0
;Bank 0
EXAMPLE 6-2:
CHANGING PRESCALER
(WDT
→TIMER0)
CLRWDT
;Clear WDT and
; prescaler
BSF
STATUS, RP0
;Bank 1
MOVLW
b’xxxx0xxx’
;Select TMR0, new
; prescale value
’ and clock source
MOVWF
OPTION_REG
;
BCF
STATUS, RP0
;Bank 0
TABLE 6-1
REGISTERS ASSOCIATED WITH TIMER0
Note:
To avoid an unintended device RESET, the
following
instruction
sequence
(Example 6-1) must be executed when
changing the prescaler assignment from
Timer0 to the WDT. This sequence must
be taken even if the WDT is disabled. To
change prescaler from the WDT to the
Timer0 module use the sequence shown in
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
Power-on
Reset
Value on all
other resets
01h
TMR0
Timer0 module’s register
xxxx xxxx
uuuu uuuu
0Bh
INTCON
GIE
EEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x
0000 0000
81h
OPTION_
REG
RBPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
85h
TRISA
—
TRISA4
TRISA3
TRISA2
TRISA1
TRISA0
---1 1111
Legend: x = unknown, u = unchanged. - = unimplemented read as ’0’. Shaded cells are not associated with Timer0.
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