參數(shù)資料
型號(hào)： PIC18F14K50-I/SO
廠(chǎng)商： Microchip Technology
文件頁(yè)數(shù)： 52/285頁(yè)
文件大小： 0K
描述： IC PIC MCU FLASH 8KX16 20-SOIC
產(chǎn)品培訓(xùn)模塊： XLP Deep Sleep Mode
8-bit PIC® Microcontroller Portfolio
視頻文件： World's Lowest Power in Sleep MCU: nanoWatt XLP
標(biāo)準(zhǔn)包裝： 38
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 48MHz
連通性： I²C，SPI，UART/USART，USB
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 14
程序存儲(chǔ)器容量： 16KB（8K x 16）
程序存儲(chǔ)器類(lèi)型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 11x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 656 (CN2011-ZH PDF)
配用： AC244023-ND - PROC EXTENS PAK PIC18F1XK50
DV164126-ND - KIT DEVELOPMENT USB W/PICKIT 2
DM164127-ND - KIT DEVELOPMENT USB 18F14/13K50
AC164112-ND - VOLTAGE LIMITER MPLAB ICD2 VPP
XLT20SO1-1-ND - SOCKET TRANS ICE 20DIP TO 20SOIC
AC164307-ND - MODULE SKT FOR PM3 28SSOP
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2010 Microchip Technology Inc.
Preliminary
DS41350E-page 145
PIC18F/LF1XK50
15.2.6
SLAVE MODE
In Slave mode, the data is transmitted and received as
external clock pulses appear on SCK. When the last bit
is latched, the SSPIF interrupt flag bit is set.
Before enabling the module in SPI Slave mode, the clock
line must match the proper Idle state. The clock line can
be observed by reading the SCK pin. The Idle state is
determined by the CKP bit of the SSPCON1 register.
While in Slave mode, the external clock is supplied by
the external clock source on the SCK pin. This external
clock must meet the minimum high and low times as
specified in the electrical specifications.
While in Sleep mode, the slave can transmit/receive
data. When a byte is received, the device will wake-up
from Sleep.
15.2.7
SLAVE SELECT
SYNCHRONIZATION
The SS pin allows a Synchronous Slave mode. The
SPI must be in Slave mode with SS pin control enabled
(SSPCON1<3:0> = 0100). When the SS pin is low,
transmission and reception are enabled and the SDO
pin is driven. When the SS pin goes high, the SDO pin
is no longer driven, even if in the middle of a transmitted
byte
and
becomes
a
floating
output.
External
pull-up/pull-down resistors may be desirable depend-
ing on the application.
When the SPI module resets, the bit counter is forced
to ‘0’. This can be done by either forcing the SS pin to
a high level or clearing the SSPEN bit.
FIGURE 15-4:
SLAVE SYNCHRONIZATION WAVEFORM
Note 1: When the SPI is in Slave mode with SS pin
control enabled (SSPCON<3:0> = 0100),
the SPI module will reset if the SS pin is
set to VDD.
2: When the SPI is used in Slave mode with
CKE set the SS pin control must also be
enabled.
SCK
(CKP = 1
SCK
(CKP = 0
Input
Sample
SDI
bit 7
SDO
bit 7
bit 6
bit 7
SSPIF
Interrupt
(SMP = 0)
CKE = 0)
(SMP = 0)
Write to
SSPBUF
SSPSR to
SSPBUF
SS
Flag
bit 0
bit 7
bit 0
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