參數(shù)資料
型號： PIC18C242T-E/SO
廠商： Microchip Technology
文件頁數(shù)： 257/279頁
文件大?。?/td> 0K
描述： IC MCU OTP 8KX16 A/D 28SOIC
標準包裝： 1,600
系列： PIC® 18C
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 22
程序存儲器容量： 16KB（8K x 16）
程序存儲器類型： OTP
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 4.2 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 5x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 帶卷 (TR)
其它名稱： PIC18C242TE/SO
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2001 Microchip Technology Inc.
DS39026C-page 77
PIC18CXX2
8.0
I/O PORTS
Depending on the device selected, there are either five
ports, or three ports available. Some pins of the I/O
ports are multiplexed with an alternate function from
the peripheral features on the device. In general, when
a peripheral is enabled, that pin may not be used as a
general purpose I/O pin.
Each port has three registers for its operation. These
registers are:
TRIS register (data direction register)
PORT register (reads the levels on the pins of the
device)
LAT register (output latch)
The data latch (LAT register) is useful for read-modify-
write operations on the value that the I/O pins are
driving.
8.1
PORTA, TRISA and LATA
Registers
PORTA is a 6-bit wide, bi-directional port. The corre-
sponding data direction register is TRISA. Setting a
TRISA bit (= 1) will make the corresponding PORTA pin
an input (i.e., put the corresponding output driver in a
Hi-Impedance mode). Clearing a TRISA bit (= 0) will
make the corresponding PORTA pin an output (i.e., put
the contents of the output latch on the selected pin).
Reading the PORTA register reads the status of the
pins, whereas writing to it will write to the port latch.
The Data Latch register (LATA) is also memory
mapped. Read-modify-write operations on the LATA
register reads and writes the latched output value for
PORTA.
The RA4 pin is multiplexed with the Timer0 module
clock input to become the RA4/T0CKI pin. The RA4/
T0CKI pin is a Schmitt Trigger input and an open drain
output. All other RA port pins have TTL input levels and
full CMOS output drivers.
The other PORTA pins are multiplexed with analog
inputs and the analog VREF+ and VREF- inputs. The
operation of each pin is selected by clearing/setting the
control bits in the ADCON1 register (A/D Control
Register1).
The TRISA register controls the direction of the RA
pins, even when they are being used as analog inputs.
The user must ensure the bits in the TRISA register are
maintained set when using them as analog inputs.
EXAMPLE 8-1:
INITIALIZING PORTA
FIGURE 8-1:
BLOCK DIAGRAM OF
RA3:RA0 AND RA5 PINS
Note:
On a Power-on Reset, these pins are con-
figured as digital inputs.
Note:
On a Power-on Reset, these pins are con-
figured as analog inputs and read as '0'.
CLRF PORTA
; Initialize PORTA by
; clearing output
; data latches
CLRF LATA
; Alternate method
; to clear output
; data latches
MOVLW 0x07
; Configure A/D
MOVWF ADCON1
; for digital inputs
MOVLW 0xCF
; Value used to
; initialize data
; direction
MOVWF TRISA
; Set RA<3:0> as inputs
; RA<5:4> as outputs
Data
Bus
Q
D
Q
CK
Q
D
Q
CK
QD
EN
P
N
WR LATA
WR TRISA
Data Latch
TRIS Latch
RD TRISA
RD PORTA
VSS
VDD
I/O pin(1)
Note 1: I/O pins have protection diodes to VDD and VSS.
Analog
Input
Mode
TTL
Input
Buffer
To A/D Converter and LVD Modules
RD LATA
or
PORTA
SS Input (RA5 only)
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