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參數(shù)資料
| 型號： | PIC16LC7X-04PTL16 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 8-Bit CMOS Microcontrollers with A/D Converter |
| 中文描述： | 8位CMOS微控制器與A / D轉(zhuǎn)換器 |
| 文件頁數(shù)： | 19/41頁 |
| 文件大小： | 322K |
| 代理商： | PIC16LC7X-04PTL16 |
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PIC16LC74B-16/PTL16
1999 Microchip Technology Inc.
Preliminary
DS30026A-page 19
FIGURE 2-11: EXAMPLE SPI MASTER MODE TIMING (CKE = 1)
TABLE 2-9:
EXAMPLE SPI MODE REQUIREMENTS (MASTER MODE, CKE = 1)
Param.
No.
71
71A
72
72A
73
Symbol
Characteristic
Min
Typ Max Units
Conditions
TscH
SCK input high time
(slave mode)
SCK input low time
(slave mode)
Setup time of SDI data input to SCK
edge
Last clock edge of Byte1 to the 1st clock
edge of Byte2
Hold time of SDI data input to SCK edge
Continuous
Single Byte
Continuous
Single Byte
1.25T
CY
+ 30
40
1.25T
CY
+ 30
40
100
—
—
—
—
—
—
—
—
—
—
ns
ns
ns
ns
ns
Note 1
TscL
Note 1
TdiV2scH,
TdiV2scL
T
B
2
B
73A
1.5T
CY
+ 40
—
—
ns
Note 1
74
TscH2diL,
TscL2diL
TdoR
TdoF
TscR
TscF
TscH2doV,
TscL2doV
TdoV2scH,
TdoV2scL
Data in “Typ” column is at 3V, 25°C unless otherwise stated. These parameters are for design guidance only
and are not tested.
Note1:
Specification 73A is only required if specifications 71A and 72A are used.
100
—
—
ns
75
76
78
79
80
SDO data output rise time
SDO data output fall time
SCK output rise time (master mode)
SCK output fall time (master mode)
SDO data output valid after SCK edge
20
10
20
10
—
45
25
45
25
100
ns
ns
ns
ns
ns
—
—
81
SDO data output setup to SCK edge
T
CY
—
—
ns
SS
SCK
(CKP = 0)
SCK
(CKP = 1)
SDO
SDI
81
71
72
74
75, 76
78
80
MSb
79
73
MSb IN
BIT6 - - - - - -1
LSb IN
BIT6 - - - -1
LSb
Note:
Refer to Figure 2.1 for load conditions.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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