參數(shù)資料
型號(hào)： PIC16LC771-E/P
廠商： Microchip Technology
文件頁數(shù)： 19/220頁
文件大?。?/td> 0K
描述： IC MCU OTP 4KX14 A/D PWM 20DIP
標(biāo)準(zhǔn)包裝： 22
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，SPI
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 15
程序存儲(chǔ)器容量： 7KB（4K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
其它名稱： PIC16LC771E/P
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2002 Microchip Technology Inc.
DS41120B-page 113
PIC16C717/770/771
11.6
A/D Sample Requirements
11.6.1
RECOMMENDED SOURCE
IMPEDANCE
The maximum recommended impedance for ana-
log sources is 2.5 k
. This value is calculated based
on the maximum leakage current of the input pin. The
leakage current is 100 nA max., and the analog input
voltage cannot be varied by more than 1/4 LSb or
250
V due to leakage. This places a requirement on
the input impedance of 250
V/100 nA = 2.5 k.
11.6.2
SAMPLING TIME CALCULATION
For the A/D converter to meet its specified accuracy,
the charge holding capacitor (CHOLD) must be allowed
to fully charge to the input channel voltage level. The
analog input model is shown in Figure 11-5. The source
impedance (RS) and the internal sampling switch (RSS)
impedance directly affect the time required to charge
the capacitor CHOLD. The sampling switch (RSS)
impedance varies over the device voltage (VDD), see
Figure 11-5. The maximum recommended imped-
ance for analog sources is 2.5 k
. After the analog
input channel is selected (changed) this sampling must
be done before the conversion can be started.
To calculate the minimum sampling time, Equation 11-
2 may be used. This equation assumes that 1/4 LSb
error is used (16384 steps for the A/D). The 1/4 LSb
error is the maximum error allowed for the A/D to meet
its specified resolution.
The CHOLD is assumed to be 25 pF for the 12-bit
A/D.
EXAMPLE 11-2:
A/D SAMPLING TIME
EQUATION
Figure 11-3 shows the calculation of the minimum time
required to charge CHOLD. This calculation is based on
the following system assumptions:
CHOLD = 25 pF
RS = 2.5 k
1/4 LSb error
VDD = 5V
→ RSS = 10 k (worst case)
Temp (system Max.) = 50
°C
Note 1: The reference voltage (VREF) has no
effect on the equation, since it cancels
itself out.
2: The charge holding capacitor (CHOLD) is
not discharged after each conversion.
3: The maximum recommended impedance
for analog sources is 2.5 k
. This is
required to meet the pin leakage specifi-
cation.
VHOL D
VREF
16384
----------------
–
=
VREF
16384
----------------
–
VREF
() 1 e
TC
–
CHOLD RIC
RSS
RS
++
()
-------------------------------------------------------------------
–
=
VREF 1
1
16384
----------------
–
VREF
() 1 e
TC
–
CHOLD RIC
RSS
RS
++
()
-------------------------------------------------------------------
–
=
TC
CHOLD 1kRSS
RS
++
()
1
16384
----------------
ln
–
=
Solving for TC:
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