參數(shù)資料
型號(hào)： PIC16LC73B-04I/ML
廠商： Microchip Technology
文件頁數(shù)： 133/184頁
文件大?。?/td> 0K
描述： IC MCU OTP 4KX14 A/D PWM 28QFN
標(biāo)準(zhǔn)包裝： 61
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 4MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 22
程序存儲(chǔ)器容量： 7KB（4K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 192 x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 5x8b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 管件
其它名稱： PIC16LC73B04I/ML
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52
SAM7S Series [DATASHEET]
6175M–ATARM–26-Oct-12
For further details on the Debug Unit, see the Debug Unit section.
12.5.4
IEEE 1149.1 JTAG Boundary Scan
IEEE 1149.1 JTAG Boundary Scan allows pin-level access independent of the device packaging technology.
IEEE 1149.1 JTAG Boundary Scan is enabled when JTAGSEL is high. The SAMPLE, EXTEST and BYPASS func-
tions are implemented. In ICE debug mode, the ARM processor responds with a non-JTAG chip ID that identifies
the processor to the ICE system. This is not IEEE 1149.1 JTAG-compliant.
It is not possible to switch directly between JTAG and ICE operations. A chip reset must be performed after JTAG-
SEL is changed.
A Boundary-scan Descriptor Language (BSDL) file is provided to set up testing.
12.5.4.1
JTAG Boundary-scan Register
The Boundary-scan Register (BSR) contains 96 bits that correspond to active pins and associated control signals.
Each SAM7Sxx input/output pin corresponds to a 3-bit register in the BSR. The OUTPUT bit contains data that
can be forced on the pad. The INPUT bit facilitates the observability of data applied to the pad. The CONTROL bit
selects the direction of the pad.
AT91SAM7S128 Rev B
0x270A0741
AT91SAM7S128 Rev C
0x270A0742
AT91SAM7S128 Rev D
0x270A0743
AT91SAM7S256 Rev A
0x270D0940
AT91SAM7S256 Rev B
0x270B0941
AT91SAM7S256 Rev C
0x270B0942
AT91SAM7S256 Rev D
0x270B0943
AT91SAM7S512 Rev A
0x270B0A40
AT91SAM7S512 Rev B
0x270B0A4F
Table 12-2.
SAM7S Series Debug Unit Chip ID (Continued)
Table 12-3.
SAM7Sxx JTAG Boundary Scan Register
Bit Number
Pin Name
Pin Type
Associated BSR
Cells
96
PA17/PGMD5/AD0
IN/OUT
INPUT
95
OUTPUT
94
CONTROL
93
PA18/PGMD6/AD1
IN/OUT
INPUT
92
OUTPUT
91
CONTROL
90
PA21/PGMD9*
IN/OUT*
INPUT
89
OUTPUT(1)
88
CONTROL(1)
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PDF描述
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