參數(shù)資料
型號(hào)： PIC16LC72
廠商： Microchip Technology Inc.
英文描述： 28-Pin 8-Bit CMOS Microcontrollers(28腳8位CMOS微控制器)
中文描述： 28引腳8位CMOS微控制器（28腳8位的CMOS微控制器）
文件頁(yè)數(shù)： 72/308頁(yè)
文件大?。?/td> 2351K
代理商： PIC16LC72
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PIC16C7X
DS30390B-page 72
1995 Microchip Technology Inc.
FIGURE 10-1: CCP1CON REGISTER (ADDRESS 17h)/CCP2CON REGISTER
(ADDRESS 1Dh)
U-0
—
bit7
U-0
—
R/W-0
CCPxX
R/W-0
CCPxY
R/W-0
CCPxM3
R/W-0
CCPxM2
R/W-0
CCPxM1 CCPxM0
R/W-0
R = Readable bit
W =Writable bit
U = Unimplemented bit,
read as ‘0’
- n =Value at POR reset
bit0
bit 7-6:
bit 5-4:
Unimplemented:
CCPxX:CCPxY
Capture Mode: Unused
Compare Mode: Unused
PWM Mode: Write the two low order bits in high resolution (10-bit) mode. May be kept constant (at '0') if
only 8-bit resolution (in standard resolution mode) is desired.
CCPxM3:CCPxM0
: CCPx Mode Select bits
0000
= Capture/compare/PWM off (resets CCPx module)
0100
= Capture mode, every falling edge
0101
= Capture mode, every rising edge
0110
= Capture mode, every 4th rising edge
0111
= Capture mode, every 16th rising edge
1000
= Compare mode, set output on match (CCPxIF bit is set)
1001
= Compare mode, clear output on match (CCPxIF bit is set)
1010
= Compare mode, generate software interrupt on match (CCPxIF bit is set, CCPx pin is unaffected)
1011
= Compare mode, trigger special event (CCPxIF bit is set; CCP1 resets TMR1; CCP2 resets TMR1
and starts an A/D conversion (if A/D module is enabled))
11xx
= PWM mode
Read as '0'
: PWM High Resolution, Low Order Select bits
bit 3-0:
10.1
Capture Mode
Applicable Devices
70 71 71A 72 73 73A 74 74A
In Capture mode, CCPR1H:CCPR1L captures the 16-
bit value of the TMR1 register when an event occurs on
pin RC2/CCP1. An event is defined as:
A falling edge
A rising edge
Every 4th rising edge
Every 16th rising edge
An event is selected by control bits CCP1M3:CCP1M0
(CCP1CON<3:0>). When a capture is made, the inter-
rupt request flag bit CCP1IF (PIR1<2>) is set. It must
be reset in software. If another capture occurs before
the value in register CCPR1 is read, the old captured
value will be lost. In capture mode, the RC2/CCP1 pin
should be configured as an input by setting its corre-
sponding TRIS bit.
When the capture mode is changed, a false capture
interrupt may be generated. The user should keep bit
CCP1IE (PIE1<2>) clear to avoid false interrupts and
should clear the flag bit CCP1IF following any such
change in operating mode.
Note:
If the RC2/CCP1 is configured as an out-
put, a write to the port can cause a capture
condition.
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