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參數(shù)資料
| 型號(hào)： | PIC16LC717T-E/SO |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 135/220頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU OTP 2KX14 A/D PWM 18SOIC |
| 標(biāo)準(zhǔn)包裝： | 1,100 |
| 系列： | PIC® 16C |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | I²C，SPI |
| 外圍設(shè)備： | 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 15 |
| 程序存儲(chǔ)器容量： | 3.5KB（2K x 14） |
| 程序存儲(chǔ)器類型： | OTP |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 6x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 18-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | PIC16LC717TE/SO |
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PIC16C717/770/771
DS41120B-page 20
2002 Microchip Technology Inc.
2.2.2.7
PIR2 REGISTER
This register contains the SSP Bus Collision and low-
voltage detect interrupt flag bits.
.
REGISTER 2-7:
PERIPHERAL INTERRUPT REGISTER 2 (PIR2: 0Dh)
Note:
Interrupt flag bits get set when an interrupt
condition occurs, regardless of the state of
its corresponding enable bit or the global
enable bit, GIE (INTCON<7>). User soft-
ware should ensure the appropriate inter-
rupt flag bits are clear prior to enabling an
interrupt.
R/W-0
U-0
R/W-0
U-0
LVDIF
—
BCLIF
—
bit 7
bit 0
bit 7
LVDIF: Low Voltage Detect Interrupt Flag bit
1
= The supply voltage has fallen below the specified LVD voltage (must be cleared in software)
0
= The supply voltage is greater than the specified LVD voltage
bit 6-4
Unimplemented: Read as '0'
bit 3
BCLIF: Bus Collision Interrupt Flag bit
1
= A bus collision has occurred while the SSP module configured in I2C Master was
transmitting (must be cleared in software)
0
= No bus collision occurred
bit 2-0
Unimplemented: Read as '0'
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
- n = Value at POR
’1’ = Bit is set
’0’ = Bit is cleared
x = Bit is unknown
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