參數(shù)資料
型號(hào)： PIC16F946-I/PT
廠商： Microchip Technology
文件頁(yè)數(shù)： 55/274頁(yè)
文件大小： 0K
描述： IC PIC MCU FLASH 8KX14 64TQFP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 160
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 53
程序存儲(chǔ)器容量： 14KB（8K x 14）
程序存儲(chǔ)器類(lèi)型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 336 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 647 (CN2011-ZH PDF)
配用： MA160011-ND - DAUGHTER BOARD PICDEM LCD 16F91X
XLT64PT5-ND - SOCKET TRAN ICE 64MQFP/TQFP
AC164305-ND - MODULE SKT FOR PM3 44TQFP
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PIC16F946
DS41265A-page 146
Preliminary
2005 Microchip Technology Inc.
11.3.2
USART SYNCHRONOUS MASTER
RECEPTION
Once Synchronous mode is selected, reception is
enabled
by
setting
either
enable
bit,
SREN
(RCSTA<5>), or enable bit, CREN (RCSTA<4>). Data
is sampled on the RC7/RX/DT/SDI/SDA/SEG8 pin on
the falling edge of the clock. If enable bit SREN is set,
then only a single word is received. If enable bit CREN
is set, the reception is continuous until CREN is
cleared. If both bits are set, CREN takes precedence.
After clocking the last bit, the received data in the
Receive Shift Register (RSR) is transferred to the
RCREG register (if it is empty). When the transfer is
complete, interrupt flag bit, RCIF (PIR1<5>), is set. The
actual interrupt can be enabled/disabled by set-
ting/clearing enable bit, RCIE (PIE1<5>). Flag bit RCIF
is a read-only bit which is reset by the hardware. In this
case, it is reset when the RCREG register has been
read and is empty. The RCREG is a double-buffered
register (i.e., it is a two-deep FIFO). It is possible for two
bytes of data to be received and transferred to the
RCREG FIFO and a third byte to begin shifting into the
RSR register. On the clocking of the last bit of the third
byte, if the RCREG register is still full, then Overrun
Error bit, OERR (RCSTA<1>), is set. The word in the
RSR will be lost. The RCREG register can be read
twice to retrieve the two bytes in the FIFO. Bit OERR
has to be cleared in software (by clearing bit CREN). If
bit OERR is set, transfers from the RSR to the RCREG
are inhibited so it is essential to clear bit OERR if it is
set. The ninth receive bit is buffered the same way as
the receive data. Reading the RCREG register will load
bit RX9D with a new value, therefore, it is essential for
the user to read the RCSTA register before reading
RCREG in order not to lose the old RX9D information.
When setting up a Synchronous Master Reception:
1.
Initialize the SPBRG register for the appropriate
2.
Enable the synchronous master serial port by
setting bits SYNC, SPEN and CSRC.
3.
Ensure bits CREN and SREN are clear.
4.
If interrupts are desired, then set enable bit
RCIE.
5.
If 9-bit reception is desired, then set bit RX9.
6.
If a single reception is required, set bit SREN.
For continuous reception, set bit CREN.
7.
Interrupt flag bit RCIF will be set when reception
is complete and an interrupt will be generated if
enable bit RCIE was set.
8.
Read the RCSTA register to get the ninth bit (if
enabled) and determine if any error occurred
during reception.
9.
Read the 8-bit received data by reading the
RCREG register.
10. If any error occurred, clear the error by clearing
bit CREN.
11. If using interrupts, ensure that GIE and PEIE
(bits 7 and 6) of the INTCON register are set.
TABLE 11-9:
REGISTERS ASSOCIATED WITH SYNCHRONOUS MASTER RECEPTION
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on:
POR, BOR
Value on
all other
Resets
0Bh, 8Bh,
10Bh,18Bh
INTCON
GIE
PEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x
0Ch
PIR1
EEIF
ADIF
RCIF
TXIF
SSPIF
CCP1IF
TMR2IF
TMR1IF
0000 0000
18h
RCSTA
SPEN
RX9
SREN
CREN ADDEN
FERR
OERR
RX9D
0000 000x
1Ah
RCREG
USART Receive Data Register
0000 0000
8Ch
PIE1
EEIE
ADIE
RCIE
TXIE
SSPIE
CCP1IE
TMR2IE
TMR1IE
0000 0000
98h
TXSTA
CSRC
TX9
TXEN
SYNC
—
BRGH
TRMT
TX9D
0000 -010
99h
SPBRG
Baud Rate Generator Register
0000 0000
Legend:
x
= unknown, – = unimplemented, read as ‘0’. Shaded cells are not used for synchronous master reception.
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PIC16HV540-04/P 功能描述:8位微控制器 -MCU .75KB 25 RAM 12 I/O 4MHz PDIP18 RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線(xiàn)寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC16HV540-04/P 制造商:Microchip Technology Inc 功能描述:IC 8BIT CMOS MCU 16HV540 DIP18
PIC16HV540-04/SO 功能描述:8位微控制器 -MCU .75KB 25 RAM 12 I/O 4MHz SOIC18 RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線(xiàn)寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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