參數(shù)資料
型號： PIC16F882
廠商： Microchip Technology Inc.
英文描述： 28/40/44-Pin, Enhanced Flash-Based 8-Bit CMOS Microcontrollers with nanoWatt Technology
中文描述： 28/40/44-Pin，增強基于閃存的納瓦技術的8位CMOS微控制器
文件頁數(shù)： 129/288頁
文件大?。?/td> 2477K
代理商： PIC16F882
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2007 Microchip Technology Inc.
Preliminary
DS41291D-page 127
PIC16F882/883/884/886/887
11.4
Compare Mode
In Compare mode, the 16-bit CCPRx register value is
constantly compared against the TMR1 register pair
value. When a match occurs, the CCPx module may:
Toggle the CCPx output
Set the CCPx output
Clear the CCPx output
Generate a Special Event Trigger
Generate a Software Interrupt
The action on the pin is based on the value of the
CCPxM<3:0> control bits of the CCPx1CON register.
All Compare modes can generate an interrupt.
FIGURE 11-2:
COMPARE MODE
OPERATION BLOCK
DIAGRAM
11.4.1
The user must configure the CCPx pin as an output by
clearing the associated TRIS bit.
CCP PIN CONFIGURATION
11.4.2
TIMER1 MODE SELECTION
In Compare mode, Timer1 must be running in either
Timer mode or Synchronized Counter mode. The
compare operation may not work in Asynchronous
Counter mode.
11.4.3
SOFTWARE INTERRUPT MODE
When Generate Software Interrupt mode is chosen
(CCPxM<3:0> =
1010
), the CCPx module does not
assert control of the CCPx pin (see the CCP1CON
register).
11.4.4
SPECIAL EVENT TRIGGER
When Special Event Trigger mode is chosen
(CCPxM<3:0> =
1011
), the CCPx module does the
following:
Resets Timer1
Starts an ADC conversion if ADC is enabled
The CCPx module does not assert control of the CCPx
pin in this mode (see the CCPxCON register).
The Special Event Trigger output of the CCP occurs
immediately upon a match between the TMR1H,
TMR1L register pair and the CCPRxH, CCPRxL
register pair. The TMR1H, TMR1L register pair is not
reset until the next rising edge of the Timer1 clock. This
allows the CCPRxH, CCPRxL register pair to
effectively provide a 16-bit programmable period
register for Timer1.
Note:
Clearing the CCP1CON register will force
the CCPx compare output latch to the
default low level. This is not the PORT I/O
data latch.
CCPRxH CCPRxL
TMR1H
TMR1L
Comparator
Q
S
R
Output
Logic
Special Event Trigger
Set CCPxIF Interrupt Flag
(PIRx)
4
Match
TRIS
Output Enable
CCPxCON<3:0>
Mode Select
Pin
Special Event Trigger will:
Clear TMR1H and TMR1L registers.
NOT set interrupt flag bit TMR1IF of the PIR1 register.
Set the GO/DONE bit to start the ADC conversion.
CCPx
Note 1:
The Special Event Trigger from the CCP
module does not set interrupt flag bit
TMRxIF of the PIR1 register.
2:
Removing the match condition by
changing the contents of the CCPRxH
and CCPRxL register pair, between the
clock edge that generates the Special
Event Trigger and the clock edge that
generates the Timer1 Reset, will preclude
the Reset from occurring.
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PDF描述
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