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  • 參數(shù)資料
    型號(hào): PIC16F690
    廠商: Microchip Technology Inc.
    英文描述: 20-Pin Flash-Based, 8-Bit CMOS Microcontrollers with nanoWatt Technology
    中文描述: 20引腳閃存的基礎(chǔ)上,8位CMOS微控制器與納瓦技術(shù)
    文件頁(yè)數(shù): 88/294頁(yè)
    文件大小: 2877K
    代理商: PIC16F690
    第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)當(dāng)前第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)第254頁(yè)第255頁(yè)第256頁(yè)第257頁(yè)第258頁(yè)第259頁(yè)第260頁(yè)第261頁(yè)第262頁(yè)第263頁(yè)第264頁(yè)第265頁(yè)第266頁(yè)第267頁(yè)第268頁(yè)第269頁(yè)第270頁(yè)第271頁(yè)第272頁(yè)第273頁(yè)第274頁(yè)第275頁(yè)第276頁(yè)第277頁(yè)第278頁(yè)第279頁(yè)第280頁(yè)第281頁(yè)第282頁(yè)第283頁(yè)第284頁(yè)第285頁(yè)第286頁(yè)第287頁(yè)第288頁(yè)第289頁(yè)第290頁(yè)第291頁(yè)第292頁(yè)第293頁(yè)第294頁(yè)
    PIC16F631/677/685/687/689/690
    DS41262D-page 86
    2007 Microchip Technology Inc.
    Timer1 gate can be inverted using the T1GINV bit of
    the T1CON register, whether it originates from the T1G
    pin or Comparator C2 output. This configures Timer1 to
    measure either the active-high or active-low time
    between events.
    6.7
    Timer1 Interrupt
    The Timer1 register pair (TMR1H:TMR1L) increments
    to FFFFh and rolls over to 0000h. When Timer1 rolls
    over, the Timer1 interrupt flag bit of the PIR1 register is
    set. To enable the interrupt on rollover, you must set
    these bits:
    TMR1ON bit of the T1CON register
    TMR1IE bit of the PIE1 register
    PEIE bit of the INTCON register
    GIE bit of the INTCON register
    The interrupt is cleared by clearing the TMR1IF bit in
    the Interrupt Service Routine.
    6.8
    Timer1 Operation During Sleep
    Timer1 can only operate during Sleep when setup in
    Asynchronous Counter mode. In this mode, an external
    crystal or clock source can be used to increment the
    counter. To set up the timer to wake the device:
    TMR1ON bit of the T1CON register must be set
    TMR1IE bit of the PIE1 register must be set
    PEIE bit of the INTCON register must be set
    T1SYNC bit of the T1CON register must be set
    TMR1CS bit of the T1CON register must be set
    T1OSCEN bit of the T1CON register (can be set)
    The device will wake-up on an overflow and execute
    the next instructions. If the GIE bit of the INTCON
    register is set, the device will call the Interrupt Service
    Routine (0004h).
    6.9
    ECCP Capture/Compare Time Base
    The ECCP module uses the TMR1H:TMR1L register
    pair as the time base when operating in Capture or
    Compare mode.
    In Capture mode, the value in the TMR1H:TMR1L
    register pair is copied into the CCPR1H:CCPR1L
    register pair on a configured event.
    In Compare mode, an event is triggered when the value
    CCPR1H:CCPR1L register pair matches the value in
    the TMR1H:TMR1L register pair. This event can be a
    Special Event Trigger.
    For more information, see
    Section 11.0 “Enhanced
    Capture/Compare/PWM Module”
    .
    6.10
    ECCP Special Event Trigger
    When the ECCP is configured to trigger a special
    event, the trigger will clear the TMR1H:TMR1L register
    pair. This special event does not cause a Timer1 inter-
    rupt. The ECCP module may still be configured to
    generate a ECCP interrupt.
    In this mode of operation, the CCPR1H:CCPR1L
    register pair becomes the period register for Timer1.
    Timer1 should be synchronized to the F
    OSC
    to utilize
    the Special Event Trigger. Asynchronous operation of
    Timer1 can cause a Special Event Trigger to be
    missed.
    In the event that a write to TMR1H or TMR1L coincides
    with a Special Event Trigger from the ECCP, the write
    will take precedence.
    For more information, see
    Section 11.2.4 “Special
    Event Trigger”
    .
    6.11
    Comparator Synchronization
    The same clock used to increment Timer1 can also be
    used to synchronize the comparator output. This
    feature is enabled in the Comparator module.
    When using the comparator for Timer1 gate, the
    comparator output should be synchronized to Timer1.
    This ensures Timer1 does not miss an increment if the
    comparator changes.
    For
    more
    information,
    “Synchronizing Comparator C2 output to Timer1”
    .
    see
    Section 8.8.2
    Note:
    TMR1GE bit of the T1CON register must
    be set to use either T1G or C2OUT as the
    Timer1 gate source. See the CM2CON1
    register (Register 8-3) for more informa-
    tion on selecting the Timer1 gate source.
    Note:
    The TMR1H:TTMR1L register pair and the
    TMR1IF bit should be cleared before
    enabling interrupts.
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