參數(shù)資料
型號(hào)： PIC16F688-I/SL
廠商： Microchip Technology
文件頁(yè)數(shù)： 21/204頁(yè)
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 4KX14 14SOIC
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 57
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，WDT
輸入/輸出數(shù)： 12
程序存儲(chǔ)器容量： 7KB（4K x 14）
程序存儲(chǔ)器類(lèi)型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-SOIC（0.154"，3.90mm 寬）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 639 (CN2011-ZH PDF)
配用： XLT14SO-1-ND - SOCKET TRANSITION 14SOIC 150/208
AC162061-ND - HEADER INTRFC MPLAB ICD2 20PIN
AC162056-ND - HEADER INTERFACE ICD2 16F688
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2009 Microchip Technology Inc.
DS41203E-page 115
PIC16F688
11.2.5
TIME-OUT SEQUENCE
On power-up, the time-out sequence is as follows: first,
PWRT time-out is invoked after POR has expired, then
OST is activated after the PWRT time-out has expired.
The total time-out will vary based on oscillator configu-
ration and PWRTE bit status. For example, in EC mode
with PWRTE bit erased (PWRT disabled), there will be
no time-out at all. Figure 11.2.1, Figure 11-5 and
Figure 11-6 depict time-out sequences. The device can
execute code from the INTOSC while OST is active by
enabling Two-Speed Start-up or Fail-Safe Monitor (see
Since the time-outs occur from the POR pulse, if MCLR
is kept low long enough, the time-outs will expire. Then,
bringing MCLR high will begin execution immediately
(see Figure 11-5). This is useful for testing purposes or
to synchronize more than one PIC16F688 device
operating in parallel.
Table 11-5 shows the Reset conditions for some
special registers, while Table 11-4 shows the Reset
conditions for all the registers.
11.2.6
POWER CONTROL (PCON)
REGISTER
The Power Control (PCON) register (address 8Eh) has
two Status bits to indicate what type of Reset that last
occurred.
Bit 0 is BOR (Brown-out). BOR is unknown on
Power-on Reset. It must then be set by the user and
checked on subsequent Resets to see if BOR = 0,
indicating that a Brown-out has occurred. The BOR
Status bit is a “don’t care” and is not necessarily
predictable
if
the
brown-out
circuit
is
disabled
(BOREN<1:0>
= 00 in the Configuration Word
register).
Bit 1 is POR (Power-on Reset). It is a ‘0’ on Power-on
Reset and unaffected otherwise. The user must write a
‘1’ to this bit following a Power-on Reset. On a
subsequent Reset, if POR is ‘0’, it will indicate that a
Power-on Reset has occurred (i.e., VDD may have
gone too low).
For more information, see Section 4.2.4 “Ultra
and
TABLE 11-1:
TIME-OUT IN VARIOUS SITUATIONS
TABLE 11-2:
PCON BITS AND THEIR SIGNIFICANCE
TABLE 11-3:
SUMMARY OF REGISTERS ASSOCIATED WITH BROWN-OUT RESET
Oscillator Configuration
Power-up
Brown-out Reset
Wake-up
from Sleep
PWRTE = 0
PWRTE = 1
PWRTE = 0
PWRTE = 1
XT, HS, LP
TPWRT + 1024
TOSC
1024 TOSC
TPWRT + 1024
TOSC
1024 TOSC
RC, EC, INTOSC
TPWRT
—TPWRT
——
POR
BOR
TO
PD
Condition
0u11
Power-on Reset
1011
Brown-out Reset
uu0u
WDT Reset
uu00
WDT Wake-up
uuuu
MCLR Reset during normal operation
uu10
MCLR Reset during Sleep
Legend: u = unchanged, x = unknown
Name
Bit 9
Bit 8
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Value on
all other
Resets(1)
CONFIG(2)
BOREN1
BOREN0
CPD
CP
MCLRE
PWRTE
WDTE
FOSC2
FOSC1
FOSC0
—
PCON
—
ULPWUE SBOREN
—
—POR
BOR
--01 --qq
--0u --uu
STATUS
IRP
RP1
RP0
TO
PD
Z
DC
C
0001 1xxx
000q quuu
Legend:
u
= unchanged, x = unknown, – = unimplemented bit, reads as ‘0’, q = value depends on condition. Shaded cells are not used by BOR.
Note
1:
Other (non Power-up) Resets include MCLR Reset and Watchdog Timer Reset during normal operation.
2:
See Configuration Word register (Register 11-1) for operation of all register bits.
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