參數(shù)資料
型號(hào)： PIC16F1827-E/ML
廠商： Microchip Technology
文件頁數(shù)： 58/109頁
文件大?。?/td> 0K
描述： MCU PIC 8BIT 4K FLASH 28-QFN
標(biāo)準(zhǔn)包裝： 61
系列： PIC® XLP™ mTouch™ 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 32MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲(chǔ)器容量： 7KB（4K x 14）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 384 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 管件
xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxx x x x xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xx xx xxxxx
xxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxx x x
xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxx
xxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxx xxx
SC1
6
C850
Al
li
n
for
m
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NXP
B.V
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2010.
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Produ
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sheet
R
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v
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1
N
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21
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f55
N
X
P
Semi
conductor
s
SC16C850
2
.5
to
3.3
V
UART
with
1
28-
byt
e
FIFOs
and
IrDA
e
n
cod
e
r/dec
ode
r
Table 8.
SC16C850 internal registers
A2 A1 A0 Register
Default[1]
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
R/W
General register set[2]
0
RHR
0xXX
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
0
THR
0xXX
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
W
0
1
IER
0x00
CTS
interrupt[3]
RTS
interrupt[3]
Xoff
interrupt[3]
Sleep
modem
status
interrupt
receive line
status
interrupt
transmit
holding
register
interrupt
receive
holding
register
interrupt
R/W
0
1
0
FCR
0x00
RCVR
trigger
(MSB)
RCVR
trigger (LSB)
TX trigger
(MSB)[3]
TX trigger
reserved
XMIT FIFO
reset
RCVR FIFO
reset
FIFOs
enable
W
0
1
0
ISR
0x01
FIFOs
enabled
FIFOs
enabled
INT priority
bit 4
INT priority
bit 3
INT priority
bit 2
INT priority
bit 1
INT priority
bit 0
INT status
R
0
1
LCR
0x00
divisor latch
enable
set break
set parity
even parity
parity
enable
stop bits
word length
bit 1
word length
bit 0
R/W
1
0
MCR
0x00
clock
select[3]
IrDA enable
INT type
loopback
OP2
OP1
RTS
DTR
R/W
1
0
1
LSR
0x60
FIFO data
error
THR and
TSR empty
THR empty
break
interrupt
framing
error
parity error
overrun
error
receive data
ready
R
1
0
1
EFCR
0x00
reserved
Enable extra
feature bit 1
Enable extra
feature bit 0
Enable
TXLVLCNT/
RXLVLCNT
W
1
0
MSR
0xX0
CD
RI
DSR
CTS
ΔCD
ΔRI
ΔDSR
ΔCTS
R
1
SPR
0xFF
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
Special register set[4]
0
DLL
0xXX
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
0
1
DLM
0xXX
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
R/W
Second special register set[6]
0
1
TXLVLCNT
0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
1
0
RXLVLCNT
0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
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PDF描述
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