參數(shù)資料
型號(hào)： PIC16C782T-I/SO
廠商： Microchip Technology
文件頁(yè)數(shù)： 9/186頁(yè)
文件大?。?/td> 0K
描述： IC MCU CMOS 8BIT 2K 20MHZ 20SOIC
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 1,600
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x8b; D/A 1x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 帶卷 (TR)
配用： AC164028-ND - MODULE SKT PROMATEII 20SOIC/DIP
其它名稱： PIC16C782TI/SO
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PIC16C781/782
DS41171A-page 104
Preliminary
2001 Microchip Technology Inc.
13.2
Control Registers
The PSMC is controlled by means of two special func-
tion registers: PSMCCON0 and PSMCCON1.
The PSMCCON0 register (Register 13-1) contains
control bits for:
Frequency of the output pulse
Minimum and maximum duty cycle in PWM mode
Fixed duty cycle in PSM mode
The PSMCCON1 register (Register 13-2) contains the
control bits for:
Enabling the PSMC module
Setting the PSMC mode
Configuring inputs and outputs
13.2.1
PSMCCON0 REGISTER
The SMCCL<1:0> bits in the PSMCCON0 register, are
used to set the pulse frequency of the PSMC.
In
the
PWM
mode,
the
MINDC
<1:0>
bits
(PSMCCON0 <5:4>) specify the minimum duty cycle.
In
the
PWM
mode,
the
MAXDC
<1:0>
bits
(PSMCCON0 <3:2>) specify the maximum duty cycle
limit.
In
the
PSM
mode,
the
DC<1:0>
bits
(PSMCCON0<1:0>) specify the fixed duty cycle.
13.2.2
PSMCCON1 REGISTER
To enable the PSMC operation, the SMCON bit in the
PSMCCON1 register must be set (see Register 13-2).
The PWM/PSM bit (PSMCCON1<1>) configures the
output mode of the PSMC. When the PWM/PSM bit is
set, the PSMC is configured for a PWM output. When
the PWM/PSM bit is cleared, a fixed duty cycle pulse is
output.
The SMCCS bit (PSMCCON1<0>) sets the input
mode. When the SMCCS bit is set, the PSMC is con-
figured for two inputs: C1 and C2. When cleared, only
Comparator C1 is used.
SMCOM bit (PSMCCON1<1>) determines the number
of outputs from the PSMC. When SMCOM is set, both
PSMC1A and PSMC1B are active. When SMCOM is
cleared, only the PSMC1A output is active and the
PSMC1B output is available for another function.
S1APOL and S1BPOL control the polarity of the PSMC
outputs. Setting the polarity bit configures the corre-
sponding output for an active low state. Clearing the bit
results in an active high output.
The SCEN bit (PSMCCON1<2>) enables the slope
compensation output. When SCEN is set (and SMCOM
is cleared) the PSMC1B output is configured to gener-
ate a slope compensation signal.
TABLE 13-5:
PSMC OUTPUT MODES
Legend: x = Don’t Care
*As needed for other functions (such as C2, RB7, T1G).
Note:
Following RESET, both the PSMC1A and
PSMC1B outputs are held tri-state until the
PSMC is configured. Driver circuitry for all
power MOSFET transistors must have a
resistor bias to turn off the transistor in the
event of tri-state conditions, on either
PSMC1A or PSMC1B, to prevent exces-
sive stress on the MOSFET's and their
associated circuitry.
Note:
Changing SMCCL<1:0> bits with the
PSMC enabled (SMCON=1) can result in
unpredictable
output.
Always
disable
PSMC before changing SMCCL<1:0>.
Note:
PSMC outputs must have their corre-
sponding direction bits cleared in TRISB;
TRISB<6>: for PSMC1A, and TRISB<7>
for PSMC1B.
FUNCTION
PSMC
PORTB
SMCOM
SCEN
TRISB<6>
TRISB<7>
Single Output
0
*
Single Output + Slope Compensation
0
1
0
Dual Output
1
x
0
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PDF描述
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