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參數(shù)資料
| 型號： | PIC16C781T-I/SS |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 37/186頁 |
| 文件大小： | 0K |
| 描述： | IC MCU CMOS 8BIT 1K 20MHZ 20SSOP |
| 產(chǎn)品培訓(xùn)模塊： | Asynchronous Stimulus |
| 標(biāo)準(zhǔn)包裝： | 1,600 |
| 系列： | PIC® 16C |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 13 |
| 程序存儲器容量： | 1.75KB（1K x 14） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8b; D/A 1x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-SSOP（0.209"，5.30mm 寬） |
| 包裝： | 帶卷 (TR) |
| 配用： | XLT20SS1-1-ND - SOCKET TRANSITION 20DIP 20SSOP |
| 其它名稱： | PIC16C781TI/SS |
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2001 Microchip Technology Inc.
Preliminary
DS41171A-page 129
PIC16C781/782
14.9.2
TMR0 INTERRUPT
An overflow (FFh
→ 00h) in the TMR0 register sets the
flag bit, T0IF (INTCON<2>). The interrupt can be
enabled/disabled by setting/clearing enable bit, T0IE
(INTCON<5>) (Section 2.5).
14.9.3
PORTB INTERRUPT-ON-CHANGE
(IOCB)
An input change on PORTB<7:0> sets flag bit RBIF
(INTCON<0>). The PORTB pin(s) which can individu-
ally generate interrupt are selectable in the IOCB regis-
ter. The interrupt can be enabled/disabled by setting/
clearing enable bit RBIE (INTCON<4>) (Section 2.5).
PORTB must be configured as a digital input.
14.10 Context Saving During Interrupts
During an interrupt, only the PC is saved on the stack.
At minimum, W and STATUS should be saved to pre-
serve the context for the interrupted program. All regis-
ters that may be corrupted by the Interrupt Service
Routine (ISR), such as PCLATH or FSR, should be
saved.
Example 14-1 stores and restores the STATUS, W and
PCLATH registers. The register, W_TEMP, is defined in
Common RAM, the last 16 bytes of each bank that may
be accessed from any bank. The STATUS_TEMP and
PCLATH_TEMP are defined in bank 0.
The example:
a)
Stores the W register.
b)
Stores the STATUS register in bank 0.
c)
Stores the PCLATH register in bank 0.
d)
Executes the ISR code.
e)
Restores the PCLATH register.
f)
Restores the STATUS register.
g)
Restores W.
EXAMPLE 14-1:
SAVING STATUS, W, AND
PCLATH REGISTERS
#define
W_TEMP
0x70
#define
STATUS_TEMP
0x71
#define
PCLATH_TEMP
0x72
org
0x04
; Int Vector
MOVWF
W_TEMP
; Save W
MOVF
STATUS,w
MOVWF
STATUS_TEMP
; save STATUS
MOVF
PCLATH,w
MOVWF
PCLATH_TEMP
; save PCLATH
:
(Interrupt Service Routine)
:
MOVF
PCLATH_TEMP,w
MOVWF
PCLATH
MOVF
STATUS_TEMP,w
MOVWF
STATUS
SWAPF
W_TEMP,f
; swapf loads W
SWAPF
W_TEMP,w
; w/o affect STATUS
RETFIE
14.11 Watchdog Timer (WDT)
The Watchdog Timer uses a free running, on-chip RC
oscillator, which does not require any external compo-
nents. This oscillator is independent from the processor
clock. The WDT runs even if the main clock of the
device has been stopped (for example, by execution of
a SLEEP instruction).
During normal operation, a WDT time-out generates a
device RESET (Watchdog Timer Reset). If the device is
in SLEEP mode, a WDT time-out causes the device to
wake-up and continue with normal operation (Watch-
dog Timer Wake-up). The TO bit in the STATUS regis-
ter is cleared upon a Watchdog Timer time-out.
The WDT can be permanently enabled by program-
ming the configuration bit WDTE, or by software via the
WDTON bit in the Power Control register (PCON:
8EH). See Section 14.8 and Section 14.1.
WDT time-out period values may be found in the Elec-
trical Specifications. Values for the WDT prescaler may
be assigned using the OPTION_REG register.
Note:
The
W_TEMP,
STATUS_TEMP
and
PCLATH_TEMP are defined in the com-
mon RAM area (70h - 7Fh) to avoid regis-
ter bank switching during context save and
restore.
Note 1: The CLRWDT and SLEEP instructions
clear the WDT and the postscaler, if
assigned to the WDT.
2: When a CLRWDT instruction is executed
and the prescaler is assigned to the WDT,
the prescaler count is cleared, but the
prescaler assignment is not changed.
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