參數(shù)資料
型號(hào)： PEF81902H
元件分類： 基準(zhǔn)電壓源/電流源
英文描述： Power Factor Controller; Package: PDIP; No of Pins: 16; Temperature Range: -40°C to +85°C
中文描述： ？4B3T第二代模塊化綜合業(yè)務(wù)數(shù)字網(wǎng)新臺(tái)幣（智能擴(kuò)展）？
文件頁(yè)數(shù)： 146/276頁(yè)
文件大小： 3611K
代理商： PEF81902H
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PEF 81912/81913
Functional Description
Data Sheet
130
2001-03-30
The XFIFO requests service from the microcontroller by setting a bit in the ISTAH
register, which causes an interrupt (XPR, XDU, XMR). The microcontroller can then read
the status register STAR (XFW, XDOV), write data in the FIFO and it may optionally
change the transmit FIFO block size (EXMR.XFBS) if required.
The instant of the initiation of a transmit pool ready (XPR) interrupt after different transmit
control commands is listed in
Table 34
.
When setting XME the transmitter appends the FCS and the endflag at the end of the
frame. When XTF & XME have been set, the XFIFO is locked until successful
transmission of the current frame, so a consecutive XPR interrupt also indicates
successful transmission of the frame, whereas after XME the XPR interrupt is asserted
as soon as there is space for one data block in the XFIFO.
The transfer block size is 32 bytes by default, but sometimes, if the microcontroller has
a high computational load, it is useful to increase the maximum reaction time for a XPR
interrupt. The maximum reaction time is:
t
max
= (XFIFO size - XFBS) / data transmission rate
With a selected block size of 16 bytes indicates a XPR interrupt when there are still 48
bytes (64 bytes - 16 bytes) to be transmitted. With a 32 bytes block size the XPR is
initiated when there are still 32 bytes (64 bytes - 32 bytes), i.d. the maximum reaction
time for the smaller block size is 50 % higher with the trade-off of a doubled interrupt
load. A selected block size of 32 or 16 bytes respectively always indicates the available
space in the XFIFO. So any number of bytes smaller than the selected XFBS may be
stored in the FIFO during one “write block“ access cycle.
Similar to RFBS for the receive FIFO, a new setting of XFBS takes effect after the next
XTF,XME or XRES command. XRES resets the XFIFO.
The XFIFO can hold any number of frames fitting in the 64 bytes.
Table 34
XPR Interrupt (availability of the XFIFO) after XTF, XME Commands
CMDR.
Transmit pool ready (XPR) interrupt initiated...
XTF
as soon as the selected buffer size in the FIFO is available
XTF &
XME
after the successful transmission of the closing flag. The transmitter
always sends an abort sequence
XME
as soon as the selected buffer size in the FIFO is available, two
consecutive frames share flags (endflag = startflag of next frame).
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PEF81912H 制造商:未知廠家 制造商全稱:未知廠家 功能描述:?2B1Q Second Generation Modular ISDN NT (Intelligent eXtended)?
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