參數(shù)資料
型號(hào)： PEB2256HT
廠商： INFINEON TECHNOLOGIES AG
英文描述： SPROM PROGRAMMER ZIF SOCKET
中文描述： E1/T1/J1成幀器和線路接口分量的長(zhǎng)途和短途應(yīng)用
文件頁(yè)數(shù)： 251/490頁(yè)
文件大?。?/td> 5893K
代理商： PEB2256HT
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FALC56 V1.2
PEB 2256
E1 Registers
Data Sheet
251
2002-08-27
SCF
Select Corner Frequency of DCO-R
Setting this bit reduces the corner frequency of the DCO-R circuit by
the factor of ten to 0.2 Hz.
Note: Reducing the corner frequency of the DCO-R circuitry
increases the synchronization time before the frequencies are
synchronized.
ELT
Enable Loop-Timed
0 =
Normal operation
1 =
Transmit clock is generated from the clock supplied by MCLK
which is synchronized to the extracted receive route clock. In
this configuration the transmit elastic buffer has to be enabled.
Refer to register XSW.XTM. For correct operation of loop timed
the remote loop (bit LIM1.RL = 0) must be inactive and bit
CMR1.DXSS must be cleared.
Loop Code Register 1 (Read/Write)
Value after reset: 00
H
EPRM
Enable Pseudo-Random Binary Sequence Monitor
0 =
Pseudo-Random Binary Sequence (PRBS) monitor is disabled.
1 =
PRBS is enabled. Setting this bit enables incrementing the
CEC2 error counter with each detected PRBS bit error. With
any change of state of the PRBS internal synchronization
status an interrupt ISR1.LLBSC is generated. The current
status of the PRBS synchronizer is indicated by bit
RSP.LLBAD.
XPRBS
Transmit Pseudo-Random Binary Sequence
A one in this bit position enables transmission of a pseudo-random
binary sequence to the remote end. Depending on bit LLBP the PRBS
is generated according to 2
15
-1 or 2
20
-1 with a maximum-14-zero
restriction (ITU-T O. 151).
7
0
LCR1
EPRM
XPRBS
LDC1
LDC0
LAC1
LAC0
FLLB
LLBP
(3B)
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PDF描述
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