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參數(shù)資料
| 型號： | PEB20321 |
| 廠商： | SIEMENS A G |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Multichannel Network Interface Controller for HDLC MUNICH32X |
| 中文描述： | 1 CHANNEL(S), 8.192M bps, SERIAL COMM CONTROLLER, PQFP176 |
| 文件頁數(shù)： | 127/366頁 |
| 文件大小： | 4832K |
| 代理商： | PEB20321 |
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PEB 20321
PEF 20321
Detailed Protocol Description
Data Sheet
127
2001-02-14
Receive Direction
General Features
In receive direction
–
the starting sequence (00
H
followed by a
‘
1
’
-bit) after initialization of
loss of synchronism is detected.
–
the synchronization pattern is monitored, after 3 consecutive
erroneous frames a loss of synchronism is detected.
–
a change of E-, S-, X-bits is monitored and reported by an interrupt.
–
the data bits are extracted and written into the data section.
More detailed description of the individual features:
The receiver can be in two different states:
Figure 50
Receiver States in V.110/X.30
1. Data extraction and monitoring of a change of E-, S-, X-bits and synchronization
pattern is only performed in synchronized state.
2. In the unsynchronized state the receiver waits for the synchronization pattern. The
‘
1
’
-
bit is then interpreted as bit 1 of octet 2.
3. During the synchronized state a change of E, S, X-bits from one frame to the next and
even within a frame (for SA, SB bits) is monitored. Only one interrupt per frame is
reported even if SA e.g. changes 3 times within the frame. The E-, S-, X-bits reported
in the interrupt are S9 for SB and S8 for SA and the second occurrence of X for X.
4. The bits written into the data section are marked by
O
in
Table 8
to
Table 10
. As
shown, bits repeated in the serial data are only strobed at their last instance.
ITD05039
RESET
Unsynchronous State
Synchronous State
3 Consecutive Erroneous Frames
(with a Frame Error)
by a "1" bit
8 * "0" bit followed
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF20324 | ICs for Communications |
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參數(shù)描述 |
|---|---|
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| PEB20324 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
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