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參數(shù)資料
| 型號： | P9S12XEP100J1MVLR |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 419/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1MVLR |
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Chapter 10 XGATE (S12XGATEV3)
BLS
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
419
Operation
If C | Z = 1, then PC + $0002 + (REL9 << 1)
PC
Branch instruction to compare unsigned numbers.
Branch if RS1
≤
RS2:
SUB
BLS
R0,RS1,RS2
REL9
CCR Effects
Code and CPU Cycles
BLS
Branch if Lower or Same
N
Z
V
C
—
—
—
—
N:
Z:
V:
C:
Not affected.
Not affected.
Not affected.
Not affected.
Source Form
Address
Mode
Machine Code
Cycles
BLS REL9
REL9
0
0
1
1
0
0
1
REL9
PP/P
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