參數資料
| 型號： | P1AFS600-2FG484 |
| 廠商： | Microsemi SoC |
| 文件頁數： | 32/334頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA PIGEON POINT 484-FBGA |
| 標準包裝： | 60 |
| 系列： | Fusion® |
| RAM 位總計： | 110592 |
| 輸入/輸出數： | 172 |
| 門數： | 600000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BGA |
| 供應商設備封裝： | 484-FPBGA（23x23） |
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Fusion Family of Mixed Signal FPGAs
Revision 4
2-111
along with the use of the active bipolar prescaler, current monitor, or temperature monitor, the minimum
sample time(s) for each must be obeyed. EQ 19 can be used to determine the appropriate value of STC.
You can calculate the minimum actual acquisition time by using EQ 16:
VOUT = VIN(1 – e–t/RC)
EQ 16
For 0.5 LSB gain error, VOUT should be replaced with (VIN –(0.5 × LSB Value)):
(VIN – 0.5 × LSB Value) = VIN(1 – e–t/RC)
EQ 17
where VIN is the ADC reference voltage (VREF)
Solving EQ 17:
t = RC x ln (VIN / (0.5 x LSB Value))
EQ 18
where R = ZINAD + RSOURCE and C = CINAD.
Calculate the value of STC by using EQ 19.
tSAMPLE = (2 + STC) x (1 / ADCCLK) or tSAMPLE = (2 + STC) x (ADC Clock Period)
EQ 19
where ADCCLK = ADC clock frequency in MHz.
ADC Clock frequency = 10 MHz or a 100 ns period.
STC = (tSAMPLE / (1 / 10 MHz)) – 2 = 4.49 – 2 = 2.49.
You must round up to 3 to accommodate the minimum sample time.
Sample Phase
A conversion is performed in three phases. In the first phase, the analog input voltage is sampled on the
input capacitor. This phase is called sample phase. During the sample phase, the output signals BUSY
and SAMPLE change from '0' to '1', indicating the ADC is busy and sampling the analog signal. The
sample time can be controlled by input signals STC[7:0]. The sample time can be calculated by EQ 20.
When controlling the sample time for the ADC along with the use of Prescaler or Current Monitor or
Temperature Monitor, the minimum sample time for each must be obeyed. Refer to Table 2-46 on
EQ 20
STC: Sample Time Control value (0–255)
tSAMPLE is the sample time
Table 2-44 Acquisition Time Example with VAREF = 2.56 V
VIN = 2.56V, R = 4K (RSOURCE ~ 0), C = 18 pF
Resolution
LSB Value (mV)
Min. Sample/Hold Time for 0.5 LSB (s)
8
10
0.449
10
2.5
0.549
12
0.625
0.649
Table 2-45 Acquisition Time Example with VAREF = 3.3 V
VIN = 3.3V, R = 4K (RSOURCE ~ 0), C = 18 pF
Resolution
LSB Value (mV)
Min. Sample/Hold time for 0.5 LSB (s)
8
12.891
0.449
10
3.223
0.549
12
0.806
0.649
tsample
2STC
+
t
ADCCLK
=
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| P1AFS600-2FGG256I | 功能描述:IC FPGA PIGEON POINT 256-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:Fusion® 產品培訓模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產品:Cyclone? IV FPGAs 標準包裝:60 系列:CYCLONE® IV GX LAB/CLB數:9360 邏輯元件/單元數:149760 RAM 位總計:6635520 輸入/輸出數:270 門數:- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應商設備封裝:484-FBGA（23x23） |
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