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參數(shù)資料
| 型號： | OR2T04A5M84-D |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 100 CLBS, 4800 GATES, PQCC84 |
| 封裝： | PLASTIC, LCC-84 |
| 文件頁數(shù)： | 123/196頁 |
| 文件大?。?/td> | 3475K |
| 代理商： | OR2T04A5M84-D |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁當(dāng)前第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁
Data Sheet
ORCA Series 2 FPGAs
January 2003
32
Lattice Semiconductor
Programmable Input/Output Cells (continued)
5-2843(F).r8
Figure 26. PIC Architecture
DT
PA
PB
PC
PD
PXL[1]
PXL[0]
PX2[2]
PX2[3]
PX2[0]
PX2[1]
PX1[0]
PX1[1]
PX1[2]
PX1[3]
PXH[1]
PXH[2]
PXH[3]
PXH[0]
B
A
C
D
FE
G
Q
PXL[0]
PXL[1]
PX2[0]
PX2[1]
PX2[2]
PX2[3]
PX1[0]
PX1[1]
PX1[2]
PX1[3]
PXH[1]
PXH[2]
PXH[3]
PXH[0]
B
A
C
D
TS0
OUT0
IN0
DOUT0
TS1
OUT1
IN1
DOUT1
TS3
OUT3
IN3
DOUT3
TS2
OUT2
IN2
DOUT2
PIC DETAIL
BIDI3
F
O
N
O
LLDRV
M
I
L
J
K
N
D
C
P
Q
M
BIDIH3
BIDIH2
BIDIH1
BIDIH0
BIDI2
BIDI1
BIDI0
LLIN3
LLIN2
LLIN1
LLIN0
P
VXL[3]
VXL[2]
VXL[1]
VXL[0]
VX1[7]
VX1[6]
VX1[5]
VX1[4]
VX1[3]
VX1[2]
VX1[1]
VX1[0]
DOUT[3]
DOUT[2]
DOUT[1]
XSW[3]
XSW[2]
XSW[1]
XSW[0]
XSW[4]
DOUT[0]
CKT
VXH[3]
VXH[2]
VXH[1]
VXH[0]
VX4[7]
VX4[6]
VX4[5]
VX4[4]
PDINTB[3]
PDINTB[2]
PDINTB[1]
PDINTB[0]
VX4[3]
VX4[2]
VX4[1]
VX4[0]
PLC-PIC Routing Resources
There is no direct connection between the inter-PIC
lines and the PLC lines. All connections to/from the
PLC must be done through the connecting lines which
are perpendicular to the lines in the PIC. The use of
perpendicular and parallel lines will be clearer if the
PLC and PIC architectures (Figure 23 and Figure 26)
are placed side by side. Twenty-nine lines in the PLC
can be connected to the 15 lines in the PIC.
Multiple connections between the PIC PX1 lines and
the PLC X1 lines are available. These allow buses
placed in any arbitrary order on the I/O pads to be
unscrambled when placed on the PLC X1 lines. Con-
nections are also available between the PIC PX2 lines
and the PLC X1 lines.
There are eight tridirectional (four TRIDI/four TRIDIH)
buffers in each PIC; they can do the following:
■
Drive a signal from an I/O pad onto one of the adja-
cent PLC’s XL or XH lines
■
Drive a signal from an I/O pad onto one of the two
PXL or four PXH lines in the PIC
■
Drive a signal from the PLC XL or XH lines onto one
of the two PXL or four PXH lines in the PIC
■
Drive a signal from the PIC PXL or PXH lines onto
one of the PLC XL or XH lines
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| OR2C26A3BA352I-DB | FPGA, 576 CLBS, 27600 GATES, PBGA352 |
| OR2C26A3BC432I-DB | FPGA, 576 CLBS, 27600 GATES, PBGA432 |
| OR2C26A4BA352-DB | FPGA, 576 CLBS, 27600 GATES, PBGA352 |
| OR2C26A4BC432-DB | FPGA, 576 CLBS, 27600 GATES, PBGA432 |
| OR2T10A4BA352-DB | FPGA, 256 CLBS, 12300 GATES, PBGA352 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| OR2T04A-5M84I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5PS100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5PS100I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5PS144 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5PS144I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
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