參數(shù)資料
    型號： OR2C08A-2PS240I
    廠商： Electronic Theatre Controls, Inc.
    元件分類： FPGA
    英文描述： Field-Programmable Gate Arrays
    中文描述： 現(xiàn)場可編程門陣列
    文件頁數(shù)： 54/192頁
    文件大?。?/td> 3148K
    代理商： OR2C08A-2PS240I
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    Data Sheet
    June 1999
    ORCA Series 2 FPGAs
    Lucent Technologies Inc.
    147
    Timing Characteristics (continued)
    Note: Speed grades of -5, -6, and -7 are for OR2TxxA devices only.
    5-4622(F).r2.a
    Figure 61. Synchronous Memory Read Cycle
    Table 40A. OR2CxxA and OR2TxxA Synchronous Memory Read Characteristics (SSPM and SDPM Modes)
    OR2CxxA Commercial: VDD = 5.0 V ± 5%, 0 °C
    ≤ TA ≤ 70 °C; OR2CxxA Industrial: VDD = 5.0 V ± 10%, –40 °C ≤ TA ≤ +85 °C.
    OR2TxxA Commercial: VDD = 3.0 V to 3.6 V, 0 °C
    ≤ TA ≤ 70 °C; OR2TxxA Industrial: VDD = 3.0 V to 3.6 V, –40 °C ≤ TA ≤
    +85 °C.
    Parameter
    Symbol
    Speed
    Unit
    -2
    -3
    -4
    -5
    -6
    -7
    Min
    Max
    Min
    Max Min Max Min Max Min Max Min Max
    Read Operation (TJ = 85 °C, VDD = min):
    Read Cycle Time
    Data Valid After Address
    (A[3:0], B[3:0] to F[3:0])
    TRC
    MEMS*_ADEL
    5.1
    —
    4.0
    3.6
    —
    2.8
    2.7
    —
    2.1
    2.4
    —
    1.7
    2.3
    —
    1.4
    2.0
    —
    1.1
    ns
    Read Operation, Clocking Data Into
    Latch/FF (TJ = 85 °C, VDD = min):
    Address to Clock Setup Time
    (A[3:0], B[3:0] to CK)
    Clock to PFU Output—Register
    (CK to Q[3:0])
    MEMS*_ASET
    REG_DEL
    2.4
    —
    2.4
    1.8
    —
    2.0
    1.2
    —
    1.9
    1.1
    —
    1.5
    1.0
    —
    1.3
    0.9
    —
    1.0
    ns
    Table 40B. OR2TxxB Synchronous Memory Read Characteristics (SSPM and SDPM Modes)
    OR2TxxB Commercial: VDD = 3.0 V to 3.6 V, 0 °C
    ≤ TA ≤ 70 °C; OR2TxxB Industrial: VDD = 3.0 V to 3.6 V, –40 °C ≤ TA ≤
    +85 °C.
    Parameter
    Symbol
    Speed
    Unit
    -7
    -8
    Min
    Max
    Min
    Max
    Read Operation (TJ = 85 °C, VDD = min):
    Read Cycle Time
    Data Valid After Address
    (A[3:0], B[3:0] to F[3:0])
    TRC
    MEMS*_ADEL
    1.9
    —
    1.8
    —
    1.4
    ns
    Read Operation, Clocking Data into
    Latch/FF (TJ = 85 °C, VDD = Min):
    Address to Clock Setup Time
    (A[3:0], B[3:0] to CK)
    Clock to PFU Output—Register
    (CK to Q[3:0])
    MEMS*_ASET
    REG_DEL
    0.9
    —
    1.0
    0.8
    —
    1.0
    ns
    A[3:0], B[3:0]
    F[3:0]
    CK
    Q[3:0]
    MEM*_ADEL
    REG_DEL
    MEM*_ASET
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    OR2C08A4BA256-DB 制造商:Lattice Semiconductor Corporation 功能描述:
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