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參數(shù)資料
| 型號： | OR2C06A-3S84 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | FPGA |
| 英文描述： | Field-Programmable Gate Arrays |
| 中文描述： | 現(xiàn)場可編程門陣列 |
| 文件頁數(shù)： | 74/192頁 |
| 文件大?。?/td> | 3148K |
| 代理商： | OR2C06A-3S84 |
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Data Sheet
June 1999
ORCA Series 2 FPGAs
Lucent Technologies Inc.
165
Timing Characteristics (continued)
Note: Serial configuration data is transmitted out on DOUT on the falling edge of CCLK after it is input on DIN.
Note: Serial configuration data is transmitted out on DOUT on the falling edge of CCLK after it is input on DIN
Figure 70. Slave Serial Configuration Mode Timing Diagram
Table 52A. OR2CxxA/OR2TxxA Slave Serial Configuration Mode Timing Characteristics
OR2CxxA Commercial: VDD = 5.0 V ± 5%, 0 °C
≤ TA ≤ 70 °C; OR2CxxA Industrial: VDD = 5.0 V ± 10%, –40 °C ≤ TA ≤ +85 °C.
OR2TxxA Commercial: VDD = 3.0 V to 3.6 V, 0 °C
≤ TA ≤ 70 °C; OR2TxxA Industrial: VDD = 3.0 V to 3.6 V, –40 °C ≤ TA ≤ +85 °C
Parameter
Symbol
Min
Max
Unit
DIN Setup Time
TS
20
—
ns
DIN Hold Time
TH
0—
ns
CCLK High Time
TCH
50
—
ns
CCLK Low Time
TCL
50
—
ns
CCLK Frequency
FC
—10
MHz
CCLK to DOUT
TD
—30
ns
Table 52B. OR2TxxB Slave Serial Configuration Mode Timing Characteristics
OR2TxxB Commercial: VDD = 3.0 V to 3.6 V, 0 °C
≤ TA ≤ 70 °C; OR2TxxB Industrial: VDD = 3.0 V to 3.6 V, –40 °C ≤ TA ≤ +85 °C.
Parameter
Symbol
Min
Max
Unit
DIN Setup Time
TS
15
—
ns
DIN Hold Time
TH
0—
ns
CCLK High Time
TCH
12.5
—
ns
CCLK Low Time
TCL
12.5
—
ns
CCLK Frequency
FC
—40
MHz
CCLK to DOUT
TD
—10
ns
5-4535(F)
DIN
CCLK
DOUT
TD
TS
TH
TCL
TCH
BIT N
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PDF描述 |
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