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參數(shù)資料
| 型號： | NB7V32MMNTXG |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 2/9頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK DIVIDER 1.8/2.5V 16-QFN |
| 標準包裝： | 3,000 |
| 系列： | GigaComm™ |
| 類型： | 時鐘除法器 |
| PLL： | 無 |
| 輸入： | CML，LVDS，LVPECL |
| 輸出： | CML |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 10GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 1.71 V ~ 2.625 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 16-QFN（3x3） |
| 包裝： | 帶卷 (TR) |
NB7V32M
http://onsemi.com
2
VREFAC GND GND GND
VCC
R VCC VCC
VCC
Q
VCC
VTCLK
CLK
56
7
8
16
15
14
13
12
11
10
9
1
2
3
4
NB7V32M
Exposed Pad (EP)
Figure 2. Pin Configuration (Top View)
VTCLK
Table 1. TRUTH TABLE
CLK
R
Q
x
H
L
H
Z
W
L
CLK B 2
Z = LOW to HIGH Transition
W = HIGH to LOW Transition
x = Don’t Care
Table 2. PIN DESCRIPTION
Pin
Name
I/O
Description
1
VTCLK
Internal 50 W Termination Pin for CLK
2
CLK
LVPECL, CML,
LVDS Input
Noninverted Differential CLK Input. (Note 1)
3
CLK
LVPECL, CML,
LVDS Input
Inverted Differential CLK Input. (Note 1)
4
VTCLK
Internal 50 W Termination Pin for CLK
5
VREFAC
Internally Generated Output Voltage Reference for CapacitorCoupled Inputs, only
6
GND
Negative Supply Voltage
7
GND
Negative Supply Voltage
8
GND
Negative Supply Voltage
9
VCC
Positive Supply Voltage. (Note 2)
10
Q
CML Output
Inverted Differential Output
11
Q
CML Output
NonInverted Differential Output
12
VCC
Positive Supply Voltage. (Note 2)
13
VCC
Positive Supply Voltage. (Note 2)
14
VCC
Positive Supply Voltage. (Note 2)
15
R
LVCMOS Input
Asynchronous Reset Input. Internal 75 kW pulldown to GND.
16
VCC
Positive Supply Voltage. (Note 2)
EP
The Exposed Pad (EP) on the QFN16 package bottom is thermally connected to the die for im-
proved heat transfer out of package. The exposed pad must be attached to a heatsinking con-
duit. The pad is electrically connected to the die, and must be electrically and thermally connected
to GND on the PC board.
1. In the differential configuration when the input termination pins (VTCLK, VTCLK) are connected to a common termination voltage or left open,
and if no signal is applied on CLK/CLK input, then the device will be susceptible to selfoscillation. Q/Q outputs have internal 50 W source
termination resistors.
2. VCC and GND pins must be externally connected to a power supply for proper operation.
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PDF描述 |
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參數(shù)描述 |
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