參數(shù)資料
型號(hào)： MX7535JP+T
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 7/16頁(yè)
文件大小： 0K
描述： IC DAC 14BIT MPU COMP 28-PLCC
標(biāo)準(zhǔn)包裝： 500
設(shè)置時(shí)間： 800ns
位數(shù)： 14
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 28-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 28-PLCC（11.51x11.51）
包裝： 帶卷 (TR)
輸出數(shù)目和類(lèi)型： 1 電流，單極；1 電流，雙極
采樣率（每秒）： *
MX7534/MX7535
Microprocessor-Compatible,
14-Bit DACs
______________________________________________________________________________________
15
ADDRESS
DECODE
CS
WR
D0–D7
A0 A1
MX7534*
*SOME CIRCUITRY OMITTED FOR CLARITY
ADDRESS BUS
A0–A15
MC6809
D0–D7
Q
E
R/W
DATA BUS
Figure 13a. MX7534—MC6809 Interface Circuit
ADDRESS
DECODE
ADDRESS BUS
CS
WR
D0–D7
A0 A1
MX7534*
*SOME CIRCUITRY OMITTED FOR CLARITY
ADDRESS BUS
A0–A15
6502
D0–D7
R/W
2
DATA BUS
Figure 13b. MX7534—6502 Interface
EN
QUAD LATCH
EN
QUAD LATCH
EN
QUAD LATCH
ADDRESS
DECODE
MICRO-
PROCESSOR
SYSTEM
A0–A15
WR
A0
A1
CS
A0
A1
D0–D7
MX7534*
*SOME CIRCUITRY OMITTED FOR CLARITY
WR
Figure 14a. MX7534—Interface Circuit Using Latches to
Minimize Digital Feedthrough
ADDRESS
DECODE
EN
16-BIT
LATCH
CSMSB
WR
D0–D13
MX7535*
*SOME CIRCUITRY OMITTED FOR CLARITY
CSLSB
LDAC
A0–A15
MICRO-
PROCESSOR
SYSTEM
D0–D15
WR
Figure 14b. MX7535—Interface Circuit Using Latches to
Minimize Digital Feedthrough
ADDRESS
DECODE
ADDRESS BUS
DATA BUS
MREQ
Z80
A0–A15
LDAC
CSMSB
CSLSB
WR
D0–D7
D8–D13
D8–D7
MX7535*
*SOME CIRCUITRY OMITTED FOR CLARITY
WR
Figure 12a. MX7535—Z80 Interface
ADDRESS
DECODE
CS
WR
D0–D7
A0 A1
MX7534*
*SOME CIRCUITRY OMITTED FOR CLARITY
ADDRESS BUS
A0–A15
Z80
D0–D7
WR
MREQ
DATA BUS
Figure 12b. MX7534—Z80 Interface
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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