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參數(shù)資料
| 型號(hào)： | MQ80C52XXX-36/883:R |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁數(shù)： | 265/310頁 |
| 文件大小： | 4427K |
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58
7799D–AVR–11/10
ATmega8U2/16U2/32U2
Bit 3 - WDEWIF: Watchdog Early Warning Interrupt Flag
This bit is set when a first time-out occurs in the Watchdog Timer and if the WDEWIE bit is
enabled. WDEWIF is automatically cleared by hardware when executing the corresponding
interrupt handling vector. Alternatively, WDIF can be cleared by writing a logic one to the flag.
When the I-bit in SREG and WDEWIE are set, the Watchdog Time-out Interrupt is executed.
Bit 2 - WDEWIE: Watchdog Early Warning Interrupt Enable
When this bit has been set by software, an interrupt will be generated on the watchdog interrupt
vector when the Early warning flag is set to one by hardware.
Bit 1:0 - WCLKD[1:0]: Watchdog Timer Clock Divider
Table 10-2.
Watchdog Timer Clock Divider Configuration
WCLKD2
WCLKD1
WCLKD0
Mode
000
ClkWDT = Clk128k
001
ClkWDT = Clk128k / 3
010
ClkWDT = Clk128k / 5
011
ClkWDT = Clk128k / 7
100
ClkWDT = Clk128k / 9
101
ClkWDT = Clk128k / 11
110
ClkWDT = Clk128k / 13
111
ClkWDT = Clk128k / 15
Table 10-3.
Watchdog Timer Prescale Select, DIV = 0 (CLKwdt = CLK128 / 1)
WDP3
WDP2
WDP1
WDP0
Number of WDT Oscillator
Cycles before 1st time-out
(Early warning)
Early warning Typical
Time-out at
V
CC = 5.0V
Watchdog
Reset/Interrupt Typical
Time-out at
V
CC = 5.0V
0
2K (2048) cycles
16 ms
32 ms
0
1
4K (4096) cycles
32 ms
64 ms
0
1
0
8K (8192) cycles
64 ms
128 ms
0
1
16K (16384) cycles
0.125 s
0.250 s
0
1
0
32K (32768) cycles
0.25 s
0.5 s
0
1
0
1
64K (65536) cycles
0.5 s
1.0 s
0
1
0
128K (131072) cycles
1.0 s
2.0 s
0
1
256K (262144) cycles
2.0 s
4.0 s
1
0
512K (524288) cycles
4.0 s
8.0 s
1
0
1
1024K (1048576) cycles
8.0 s
16.0 s
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MQ82380-20 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MQ82380-20/R | 制造商:Rochester Electronics LLC 功能描述: |
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