參數(shù)資料
型號: MQ80C154-12P883R
廠商: ATMEL CORP
元件分類: 微控制器/微處理器
英文描述: 8-BIT, 12 MHz, MICROCONTROLLER, CQFP44
封裝: CERAMIC, QFP-44
文件頁數(shù): 280/336頁
文件大小: 8801K
代理商: MQ80C154-12P883R
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ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
of the Watchdog System Reset mode. If the interrupt is not executed before the next time-out, a System Reset will
be applied.
Note:
1. For the WDTON Fuse “1” means unprogrammed while “0” means programmed.
Bit 4 - WDCE: Watchdog Change Enable
This bit is used in timed sequences for changing WDE and prescaler bits. To clear the WDE bit, and/or change the
prescaler bits, WDCE must be set.
Once written to one, hardware will clear WDCE after four clock cycles.
Bit 3 - WDE: Watchdog System Reset Enable
WDE is overridden by WDRF in MCUSR. This means that WDE is always set when WDRF is set. To clear WDE,
WDRF must be cleared first. This feature ensures multiple resets during conditions causing failure, and a safe
start-up after the failure.
Bit 5, 2:0 - WDP[3:0]: Watchdog Timer Prescaler 3, 2, 1 and 0
The WDP3:0 bits determine the Watchdog Timer prescaling when the Watchdog Timer is running. The different
prescaling values and their corresponding time-out periods are shown in Table 10-2 on page 49.
Table 10-1.
Watchdog timer configuration.
WDTON
WDE
WDIE
Mode
Action on time-out
0
Stopped
None
0
1
Interrupt mode
Interrupt
0
1
0
System Reset mode
Reset
01
1
Interrupt and System Reset
mode
Interrupt, then go to System
Reset mode
1
x
System Reset mode
Reset
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