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參數(shù)資料
| 型號(hào)： | MPC9850VF |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類(lèi)： | 時(shí)鐘產(chǎn)生/分配 |
| 英文描述： | 500 MHz, PROC SPECIFIC CLOCK GENERATOR, PBGA100 |
| 封裝： | MAPBGA-100 |
| 文件頁(yè)數(shù)： | 5/12頁(yè) |
| 文件大?。?/td> | 243K |
| 代理商： | MPC9850VF |
Advanced Clock Drivers Devices
2
Freescale Semiconductor
MPC9850
Figure 1. MPC9850 Logic Diagram
Table 1. Pin Configurations
Pin
I/O
Type
Function
Supply
Active/State
CLK
Input
LVCMOS
PLL Reference Clock Input (pull-down)
VDD
PCLK, PCLK
Input
LVPECL
PLL Reference Clock Input (PCLK - pull-down, PCLK - pull-up and
pull-down)
VDD
QA0, QA1, QA2, QA3 Output
LVCMOS
Bank A Outputs
VDDOA
QB0, QB1, QB2, QB3 Output
LVCMOS
Bank B Outputs
VDDOB
QC0, QC1, QC0,
QC1
Output
LVDS
Bank C Outputs
VDDOC
REF_OUT
Output
LVCMOS
Reference Output (25 MHz or 33 MHz)
VDD
XTAL_IN
Input
LVCMOS
Crystal Oscillator Input Pin
VDD
XTAL_OUT
Output
LVCMOS
Crystal Oscillator Output Pin
VDD
REF_CLK_SEL
Input
LVCMOS
Select between CLK and PCLK Input (pull-down)
VDD
High
REF_SEL
Input
LVCMOS
Select between External Input and Crystal Oscillator Input (pull-down) VDD
High
REF_33MHz
Input
LVCMOS
Selects 33 MHz Input (pull-down)
VDD
High
MR
Input
LVCMOS
Master Reset (pull-up)
VDD
Low
PLL_BYPASS
Input
LVCMOS
Select PLL or static test mode (pull-down)
VDD
High
CLK_A[0:5](1)
1. PowerPC bit ordering (bit 0 = msb, bit 5 = lsb)
Input
LVCMOS
Configures Bank A clock output frequency (pull-up)
VDD
High
CLK_B[0:5](2)
2. PowerPC bit ordering (bit 0 = msb, bit 5 = lsb)
PowerPC bit ordering (bit 0 = msb, bit 1 = lsb)
Input
LVCMOS
Configures Bank B clock output frequency (pull-up)
VDD
High
RIO_C [0:1]
Input
LVCMOS
Configures Bank C clock output frequency (pull-down)
VDD
3.3 V Supply
VDDA
Analog Supply
VDDOA
Supply for Output Bank A
VDDOB
Supply for Output Bank B
VDDOC
Supply for Output Bank C
GND
Ground
÷N
÷4, 8, 16, 40
QC0
PCLK
CLK
REF_CLK_SEL
XTAL_IN
XTAL_OUT
REF_SEL
PLL_BYPASS
REF_33MHz
CLK_A[0:5]
CLK_B[0:5]
RIO_C[0:1]
MR
QC1
REF_OUT
QC1
QC0
QB3
QB2
QB1
QB0
QA3
QA2
QA1
QA0
÷N
PLL
2000 MHz
Ref
OSC
0
1
0
1
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC9850VMR2 | 500 MHz, PROC SPECIFIC CLOCK GENERATOR, PBGA100 |
| MPC9850VMR2 | 500 MHz, PROC SPECIFIC CLOCK GENERATOR, PBGA100 |
| MPC9850VFR2 | 500 MHz, PROC SPECIFIC CLOCK GENERATOR, PBGA100 |
| MPC9992FAR2 | 400 MHz, OTHER CLOCK GENERATOR, PQFP32 |
| MPD70F3224GC(A)-8EU | RISC MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC9850VM | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類(lèi)型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9850VMR2 | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類(lèi)型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9855 | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:Clock Generator for PowerQUICC and PowerPC Microprocessors |
| MPC9855VM | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類(lèi)型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9855VMR2 | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類(lèi)型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
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