參數(shù)資料
型號(hào)： MPC875VR133
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 47/84頁(yè)
文件大?。?/td> 0K
描述： IC MPU POWERQUICC 133MHZ 256PBGA
標(biāo)準(zhǔn)包裝： 60
系列： MPC8xx
處理器類型： 32-位 MPC8xx PowerQUICC
速度： 133MHz
電壓： 3.3V
安裝類型： 表面貼裝
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-PBGA（23x23）
包裝： 托盤
MPC875/MPC870 PowerQUICC Hardware Specifications, Rev. 4
Freescale Semiconductor
51
CPM Electrical Characteristics
Figure 47. CPM General-Purpose Timers Timing Diagram
13.5
Serial Interface AC Electrical Specifications
Table 21 provides the serial interface (SI) timings as shown in Figure 48 through Figure 52.
Table 21. SI Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
70
L1RCLKB, L1TCLKB frequency (DSC = 0)1, 2
—
SYNCCLK/2.5
MHz
71
L1RCLKB, L1TCLKB width low (DSC = 0)2
P + 10
—
ns
71a
L1RCLKB, L1TCLKB width high (DSC = 0)3
P + 10
—
ns
72
L1TXDB, L1ST1 and L1ST2, L1RQ, L1CLKO rise/fall time
—
15.00
ns
73
L1RSYNCB, L1TSYNCB valid to L1CLKB edge (SYNC setup time)
20.00
—
ns
74
L1CLKB edge to L1RSYNCB, L1TSYNCB, invalid (SYNC hold time)
35.00
—
ns
75
L1RSYNCB, L1TSYNCB rise/fall time
—
15.00
ns
76
L1RXDB valid to L1CLKB edge (L1RXDB setup time)
17.00
—
ns
77
L1CLKB edge to L1RXDB invalid (L1RXDB hold time)
13.00
—
ns
78
L1CLKB edge to L1ST1 and L1ST2 valid4
10.00
45.00
ns
78A
L1SYNCB valid to L1ST1 and L1ST2 valid
10.00
45.00
ns
79
L1CLKB edge to L1ST1 and L1ST2 invalid
10.00
45.00
ns
80
L1CLKB edge to L1TXDB valid
10.00
55.00
ns
80A
L1TSYNCB valid to L1TXDB valid4
10.00
55.00
ns
81
L1CLKB edge to L1TXDB high impedance
0.00
42.00
ns
82
L1RCLKB, L1TCLKB frequency (DSC = 1)
—
16.00 or
SYNCCLK/2
MHz
83
L1RCLKB, L1TCLKB width low (DSC = 1)
P + 10
—
ns
CLKO
TIN/TGATE
(Input)
TOUT
(Output)
64
65
61
62
63
61
60
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PDF描述
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