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參數(shù)資料
| 型號(hào)： | MPC860DT |
| 廠(chǎng)商： | Motorola, Inc. |
| 英文描述： | Family Hardware Specifications |
| 中文描述： | 家庭硬件規(guī)格 |
| 文件頁(yè)數(shù)： | 38/76頁(yè) |
| 文件大?。?/td> | 857K |
| 代理商： | MPC860DT |
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38
MPC860 Family Hardware Specifications
MOTOROLA
Bus Signal Timing
Figure 9-29 provides the input timing for the debug port clock.
Figure 9-29. Debug Port Clock Input Timing
Figure 9-30 provides the timing for the debug port.
Figure 9-30. Debug Port Timings
Table 9-10. Debug Port Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
P61
DSCK cycle time
3
×
T
CLOCKOUT
1.25
×
T
CLOCKOUT
—
—
P62
DSCK clock pulse width
—
—
P63
DSCK rise and fall times
0.00
3.00
ns
P64
DSDI input data setup time
8.00
—
ns
P65
DSDI data hold time
5.00
—
ns
P66
DSCK low to DSDO data valid
0.00
15.00
ns
P67
DSCK low to DSDO invalid
0.00
2.00
ns
DSCK
D61
D61
D63
D62
D62
D63
DSCK
DSDI
DSDO
D64
D65
D66
D67
相關(guān)PDF資料 |
PDF描述 |
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| MPC860EN | Family Hardware Specifications |
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