2C
參數(shù)資料
型號(hào): MPC8572EVTAULE
廠商: Freescale Semiconductor
文件頁(yè)數(shù): 103/138頁(yè)
文件大小: 0K
描述: MPU POWERQUICC III 1023FCPBGA
標(biāo)準(zhǔn)包裝: 1
系列: MPC85xx
處理器類型: 32-位 MPC85xx PowerQUICC III
速度: 1.333GHz
電壓: 1.1V
安裝類型: 表面貼裝
封裝/外殼: 1023-BBGA,F(xiàn)CBGA
供應(yīng)商設(shè)備封裝: 1023-FCPBGA(33x33)
包裝: 托盤
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MPC8572E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5
Freescale Semiconductor
67
I
2C
Figure 39 provides the boundary-scan timing diagram.
Figure 39. Boundary-Scan Timing Diagram
13 I2C
This section describes the DC and AC electrical characteristics for the I2C interfaces of the MPC8572E.
13.1
I2C DC Electrical Characteristics
Table 54 provides the DC electrical characteristics for the I2C interfaces.
Table 54. I2C DC Electrical Characteristics
Parameter
Symbol
Min
Max
Unit
Notes
Input high voltage level
VIH
0.7
× OVDD
OVDD + 0.3
V
Input low voltage level
VIL
–0.3
0.3
× OVDD
V—
Low level output voltage
VOL
00.4
V
1
Pulse width of spikes which must be suppressed by the
input filter
tI2KHKL
050
ns
2
Input current each I/O pin (input voltage is between
0.1
× OVDD and 0.9 × OVDD(max)
II
–10
10
μA3
Capacitance for each I/O pin
CI
—10
pF
Notes:
1. Output voltage (open drain or open collector) condition = 3 mA sink current.
2. Refer to the
MPC8572E PowerQUICC III Integrated Host Processor Family Reference Manual for information on the digital
filter used.
3. I/O pins will obstruct the SDA and SCL lines if OVDD is switched off.
VM = Midpoint Voltage (OVDD/2)
VM
tJTDVKH
tJTDXKH
Boundary
Data Outputs
Boundary
Data Outputs
JTAG
External Clock
Boundary
Data Inputs
Output Data Valid
tJTKLDX
tJTKLDZ
tJTKLDV
Input
Data Valid
Output Data Valid
相關(guān)PDF資料
PDF描述
IDT7015L12PF IC SRAM 72KBIT 12NS 80TQFP
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IDT70V25L25J8 IC SRAM 128KBIT 25NS 84PLCC
MPC8572EPXAULD MPU POWERQUICC III 1023-PBGA
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參數(shù)描述
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MPC8572LPXARLE 制造商:Freescale Semiconductor 功能描述:38H R211 NOE SNPB 1067LP - Bulk