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參數(shù)資料
| 型號： | MPC8548CHXAQG |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 1000 MHz, MICROPROCESSOR, CBGA783 |
| 封裝： | 29 X 29 MM, 1 MM PITCH, FLIP CHIP, CERAMIC, BGA-783 |
| 文件頁數(shù)： | 74/142頁 |
| 文件大?。?/td> | 1504K |
| 代理商： | MPC8548CHXAQG |
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MPC8548E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5
Freescale Semiconductor
37
Enhanced Three-Speed Ethernet (eTSEC)
Figure 17 shows the RGMII and RTBI AC timing and multiplexing diagrams.
Figure 17. RGMII and RTBI AC Timing and Multiplexing Diagrams
8.2.7
RMII AC Timing Specifications
This section describes the RMII transmit and receive AC timing specifications.
8.2.7.1
RMII Transmit AC Timing Specifications
The RMII transmit AC timing specifications are in Table 34.
Table 34. RMII Transmit AC Timing Specifications
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
TSEC
n_TX_CLK clock period
tRMT
15.0
20.0
25.0
ns
TSEC
n_TX_CLK duty cycle
tRMTH
35
50
65
%
TSEC
n_TX_CLK peak-to-peak jitter
tRMTJ
——
250
ps
Rise time TSEC
n_TX_CLK (20%–80%)
tRMTR
1.0
—
2.0
ns
Fall time TSEC
n_TX_CLK (80%–20%)
tRMTF
1.0
—
2.0
ns
GTX_CLK
tRGT
tRGTH
tSKRGT
TX_CTL
TXD[8:5]
TXD[7:4]
TXD[9]
TXERR
TXD[4]
TXEN
TXD[3:0]
(At Transmitter)
TXD[8:5][3:0]
TXD[7:4][3:0]
TX_CLK
(At PHY)
RX_CTL
RXD[8:5]
RXD[7:4]
RXD[9]
RXERR
RXD[4]
RXDV
RXD[3:0]
RXD[8:5][3:0]
RXD[7:4][3:0]
RX_CLK
(At PHY)
tSKRGT
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