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參數(shù)資料
| 型號： | MPC8536E-ANDROID |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 14/126頁 |
| 文件大?。?/td> | 0K |
| 描述： | HARDWARE/SOFTWARE ANDROID OS |
| 標準包裝： | 1 |
| 系列： | PowerQUICC ™ |
| 類型： | MPU |
| 適用于相關(guān)產(chǎn)品： | MPC8536 |
| 所含物品： | 板 |
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MPC8536E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5
Electrical Characteristics
Freescale Semiconductor
110
2.23.6
Frequency Options
2.23.6.1
SYSCLK to Platform Frequency Options
This table shows the expected frequency values for the platform frequency when using a CCB clock to SYSCLK ratio in
comparison to the memory bus clock speed.
2.23.6.2
Minimum Platform Frequency Requirements for High-speed Interfaces
Section 4.4.3.8 “SerDes1 I/O Port Selection” and Section 4.4.3.9 “SerDes2 I/O Port Selection” of the MPC8536E
PowerQUICC III Integrated Host Processor Family Reference Manual, describes various high-speed interface configuration
options. Note that the CCB clock frequency must be considered for proper operation of such interfaces as described below.
For proper PCI Express operation, the CCB clock frequency must be equal or greater than:
See Section 18.1.3.2, “Link Width,” of the MPC8536E PowerQUICC III Integrated Host Processor Family Reference Manual,
for PCI Express interface width details. Note that the “PCI Express link width” in the above equation refers to the negotiated
link width as the result of PCI Express link training, which may or may not be the same as the link width POR selection.
2.24
Thermal
This section describes the thermal specifications of the chip.
Table 78. Frequency Options of SYSCLK with Respect to Memory Bus Speeds
CCB to
SYSCLK Ratio
SYSCLK (MHz)
33.33
41.66
66.66
83
100
111
133.33
Platform /CCB Frequency (MHz)
3
333
400
4
333
400
444
533
5
333
415
500
6
400
500
8
333
533
10
333
417
12
400
500
16
533
527 MHz
PCI Express link width
()
×
8
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