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參數(shù)資料
| 型號： | MPC8533EVTANG |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 800 MHz, MICROPROCESSOR, PBGA783 |
| 封裝： | 29 X 29 MM, 1 MM PITCH, LEAD FREE, PLASTIC, FC-PBGA-783 |
| 文件頁數(shù)： | 30/116頁 |
| 文件大?。?/td> | 1273K |
| 代理商： | MPC8533EVTANG |
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MPC8533E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 3
20
Freescale Semiconductor
DDR and DDR2 SDRAM
Figure 3 shows the DDR SDRAM input timing diagram.
Figure 3. DDR SDRAM Input Timing Diagram (tDISKEW)
6.2.2
DDR SDRAM Output AC Timing Specifications
Table 18 provides the output AC timing specifications for the DDR SDRAM interface.
Table 18. DDR SDRAM Output AC Timing Specifications
At recommended operating conditions.
Parameter
Symbol1
Min
Max
Unit
Notes
MCK[n] cycle time, MCK[n]/MCK[n] crossing
tMCK
3.75
6
ns
2
ADDR/CMD output setup with respect to MCK
tDDKHAS
ns
3
533 MHz
400 MHz
333 MHz
1.48
1.95
2.40
—
7
ADDR/CMD output hold with respect to MCK
tDDKHAX
ns
3
533 MHz
400 MHz
333 MHz
1.48
1.95
2.40
—
7
—
MCS[n] output setup with respect to MCK
tDDKHCS
ns
3
533 MHz
400 MHz
333 MHz
1.48
1.95
2.40
—
7
—
MCS[n] output hold with respect to MCK
tDDKHCX
ns
3
533 MHz
400 MHz
333 MHz
1.48
1.95
2.40
—
7
—
MCK to MDQS Skew
tDDKHMH
–0.6
0.6
ns
4
MCK[n]
tMCK
MDQ[x]
MDQS[n]
D1
D0
tDISKEW
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC8533EVTARJ | 32-BIT, 1067 MHz, MICROPROCESSOR, PBGA783 |
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| MPC8560PXAPDB | 32-BIT, 833 MHz, RISC PROCESSOR, PBGA783 |
| MPC8560PXALDB | 32-BIT, 667 MHz, RISC PROCESSOR, PBGA783 |
| MPC8560CPXALFB | 32-BIT, 667 MHz, RISC PROCESSOR, PBGA783 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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